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[参考译文] MSP430FR2633:在 BSL 序列后确认通信的开始时序

Guru**** 2595805 points
Other Parts Discussed in Thread: MSP430FR2633

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/647394/msp430fr2633-confirm-the-start-timing-of-communication-after-bsl-sequence

器件型号:MSP430FR2633

尊敬的 TI 专家:

请允许我确认以下问题。
[问题]

请告诉我在 BSL 启动序列后启动 BSL 通信的最短时间吗?


关于客户、如果该范围小于500ms、则 MSP430FR2633没有响应。 这就是为什么他们不想知道这段时间的最短时间。
如果您有任何疑问、请告诉我。
此致。
Kaka

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    您好 Kaka、

    我们没有关于 BSL 调用和开始通信之间的最短时间的规格。 通过 I2C 和 UART 接收到字符后、我们有一个1.2ms 的新字符规范。

    查看您的波形、我发现有两个问题。
    1.我看不到完全正确的 BSL 进入序列。 当 RST 为低电平时、您应该有一个高脉冲在 TEST 上、然后在第二个测试脉冲期间使 RST 变为高电平。 请参阅《MSP430 FRAM 器件引导加载程序(BSL)用户指南》(http://www.ti.com/lit/slau550)第3.3.2节中的图2

    2.按照 I2C 标准,您的 SCL 线路似乎没有被拉高。 请仔细检查 I2C 线路上的上拉电阻。 如果这不是问题、则表明 SCL 线路保持低电平并停止总线。 此时 MSP430不应执行此操作、因为它应该处于在 BSL 调用后接收 I2C 通信的状态。 请检查主器件是否已准备好发送 I2C 数据或 I2C 上的其他器件是否未挂起总线。
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    Kaka、

    与同事交谈后的更新。 尽管我们没有指定最短时间、但您必须等待器件完全启动。 这意味着等待时间为~280ms 的 FLL 锁定。
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    您好、JH、

    所附的波形如下所示。
    PC (BSL-Scripter)-USB--MSP-FET -MSP430FR2633EVM
    写入闪存映像没有任何问题。
    如果此波形有任何问题,请检查 BSL-Scripter 并对其进行修订。

    此致。
    Kaka
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    您好、JH、

    感谢您的更新。
    我认为您应该在 BSL 文档或数据表中描述"等待时间为~280ms 的 FLL 锁定"。

    顺便说一下、这个值是指数据表上的"tFLL、锁定 FLL 锁定时间"。 对吧?
    这个条件是 MSP430FR2633使用 XT1晶振作为时钟源。 如果他们没有将晶振用于 XT1、他们应该等待多长时间?

    此致。
    Kaka
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    Kaka、

    FLL 锁定时间用于 DCO、而不是 XTAL。 无论使用 DCO (默认)、都会执行此过程。 此外、在进入 BSL 时、器件将如同从复位开始一样、因此还不会设置 XT1。 此外、XTAL 启动具有更长的延迟。

    我看不到您的附件。 您可以再试一次吗?
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    您好、JH、

    感谢您的回答。 我明白了。
    附件表示我的第一个 POST 波形。

    此致。
    Kaka