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[参考译文] MSP430FR4133:MSP430FR4133

Guru**** 1135610 points
Other Parts Discussed in Thread: MSP430FR4133
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/1349441/msp430fr4133-msp430fr4133

器件型号:MSP430FR4133

MCU:MSP430FR4133。
1) 1)应用程序代码正在执行并将 P8.3引脚状态设置为输出高电平状态。
2) MSP430FR4133通过在 RST 和 TEST 引脚上设置的 BSL 进入序列进入 BSL (引导加载程序)模式。
在向 BSL 模式转换期间、包括 P8.3在内的所有 GPIO 引脚的状态是否都保持锁定或保留在进入 BSL 模式之前的相同状态?

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    嗨、 

    GPIO 在默认模式下检测 BSL (未初始化状态)。

    此致、

    赫利克

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    尊敬的 Helic Chi:

    根据 www.ti.com/.../slau445i.pdf

    "

    在 LPMx.5期间、I/O 引脚的状态将保持并根据进入 LPMx.5之前的设置锁定。 注意
    这个唯一的 引脚条件会保留下来、 。 所有其他端口配置寄存器设置、例如 PxDIR、
    PxREN、PxOUT、PxIES 和 PxIE 内容丢失。
    在退出 LPMx.5后、所有外设寄存器被设置为它们的缺省条件、但是 I/O 引脚保持
    在 LOCKLPM5保持被置位时被锁定。 将 I/O 引脚保持在被锁定状态可确保所有引脚条件保持
    无论默认 I/O 寄存器设置如何、均可在进入工作模式时保持稳定。
    当返回激活模式时、I/O 配置和 I/O 中断配置、例如 PxDIR、PxREN、
    PxOUT、和 PxIES 应该被恢复至进入 LPMx.5前的值。 LOCKLPM5位可以通过
    然后被清除、这将释放 I/O 引脚条件和 I/O 中断配置。 更改
    LOCKLPM5置1时的端口配置寄存器对 I/O 引脚无影响。
    通过配置 PxIE 使能 I/O 中断后、可以使用导致唤醒的 I/O 中断
    由 PxIFG 标志所表示的那样处理。 这些标志可以直接使用、或相应的 PxIV
    寄存器。 请注意、在 LOCKLPM5位已经被清零前、PxIFG 标志不能被清零
    被清除。

    "

    这是否意味着、如果我在进入 BSL 模式之前处于 LPMx.5、那么我可以保留引脚的状态?

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    尊敬的 Rajan:

    1. 当 MSP430Fr4133处于引导加载程序(BSL)模式时:
      • 为了便于 UART 通道上的数据发送和接收、BSL 模式强制要求使用特定输入/输出(I/O)配置。
      • 这些配置对于 UART 通信的正确运行至关重要。
    2. 并非所有 GPIO 引脚都可以被均匀锁定:
      • 根据 BSL 模式要求、某些 GPIO 引脚的状态可能被锁定。
      • 其他 GPIO 引脚也许会返回到它们的缺省模式或者按照 LOCKLPM5来锁定其状态。  

    因此、我认为不可能在 BSL 模式下锁定所有 GPIO 引脚状态。

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    大家好、  和 

    对于 LPMx.5、这是关于 LPM 和运行模式之间的切换。

    对于 BSL、进入 BSL 需要一个复位和测试引脚信号。 任何用户应用程序代码都不会影响 BSL GPIO 状态。

    如果器件支持用户定义的 BSL 代码、我们可以修改 GPIO、但仍有一段时间的复位条件。

    此致、

    赫利克