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[参考译文] MSP430FR5739-GPIO:MSP430FR5739-GPIO:EP 上电时出现 EP 问题

Guru**** 1831610 points
Other Parts Discussed in Thread: MSP430FR5739
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/1414144/msp430fr5739-ep-msp430fr5739-ep-gpio-issue-at-power-on

器件型号:MSP430FR5739-MSP430FR5739-EVM EP
主题中讨论的其他器件:MSP430FR5739

工具与软件:

我在 MSP430FR5739的 GPIO 上遇到了一个奇怪的问题。 发生频率为  

 在300多个 µC 中、此问题仅出现几 μ s。

我们将 P1.3、P1.2和 P2.4用于3个具有3个外部上拉电阻的数字传感器。

问题在于、在某些情况下、当接通电源时、P1.3 (只有 P1.3、P1.2和 P2.4运行良好)读数为0、传感器输出为1 (我们 在没有传感器的情况下也是如此、P1.3仍为0、但在示波器上我们看到良好的3.3V)。

我们创建了一个新代码、非常简单、仅使用 while (1){read 3 sensors}的时钟配置、但问题仍然存在。

 此问题仅在初始状态下出现、因为当传感器处于使用状态时(如果它从1切换、有问题:读取0、然后读取0、然后读取1、则读取1!) GPIO 将正常工作。

我在 MSP430FR5659上只看到一个案例:  

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/549717/msp430f5659-gpio-input-port-issue

没有答案。

我曾尝试将 GPIO 在初始化时置于输出低电平、然后置于输入、这样就能正常工作。

是否可能在上电时阻止 GPIO?

PCB 上没有问题。

此致

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你(们)好

    我根据 数据表的第60-63页检查了 P1.2和 P1.3的输入/输出原理图

    我认为 P1.2和 P1.3是相似的

    >>此问题仅在初始状态下出现、因为当传感器处于使用状态时(如果它从1切换出现问题:读取0、然后读取0、然后读取1、则读取1!) GPIO 将正常工作。

    请您详细说明"此问题只能在初始状态下看到"?

    这意味着 GPIO 将在多次使用"0"后读取到"1"正确代码?

    读取到"1"?需要多长时间

    谢谢!

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你好。 我会尝试更精确。

    如果没有传感器、只有一个上拉电阻器。 因此、GPIO 物理值为1、但 GPIO 读取为0、节点变为1。

    对于传感器、如果 GPIO 的物理值为1、并且我们关闭了电源、然后打开了 GPIO 读取0、那么它将变为1、除非传感器发送0、然后发送1。

    对我来说、这似乎是一个阻止的 GPIO、极化和电流会解锁 GPIO。  

    对于示例、如果我将、在初始化过程中、GPIO 先处于输出低电平、然后在输入中运行良好。

    此致

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    在勘误表上找到答案!

    https://www.ti.com/lit/er/slaz392ah/slaz392ah.pdf P18 PORT26.

    @TI 生产批次中的 µC 所占比例是多少?

    详细信息:

    PORT26 端口模块

    分类功能

    功能上电期间 P1.3/P1.4输入引脚的值不正确

    说明如果 P1.3/P1.4在上电期间从外部上拉至 DVCC、则器件可能读取到的逻辑高电平值不正确(读取零而不是一)。

    解决方法

     1) 1)下电上电后、通过以下方式将 P1.3/P1.4端口切换为逻辑零:

        a)将关键 GPIO 切换至输出低电平(使用串联电阻限制电流)

        或者

        b)移除外部上拉连接以通过内部下拉将 GPIO 拉

    或者

     2) 2)使用不同的 GPIO (不是 P1.3和 P1.4)

    或者

     3) 3)在 SW 中更改逻辑检查的极性(为 GPIO 启用内部上拉电阻、并将外部引脚拉至 DVSS)