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[参考译文] EVM430-FR6043:PPG 的频率限制

Guru**** 1831230 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/1415981/evm430-fr6043-frequency-limitations-of-the-ppg

器件型号:EVM430-FR6043

工具与软件:

您好!

我们将根据此开发套件设计风速计。  TI 的风速计示例使用200kHz 换能器。  我们需要使用更低的频率。  我已经看到、DK 频率可被降低至133kHz、但是将 PLL 值调整至68。  

阻止我们低于此值的限制是什么?  我们想使用40kHz 传感器。  如果我们设计了一个具有较低晶振频率的电路板、我们是否能够将 PLL 配置成更慢的运行速度、同时仍然使 USSLib 工作?  或者是以某种方式硬编码到库中的133kHz 限制。  

我只是想了解哪些因素决定了低端换能器频率。

谢谢!

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    限制在于硬件。 PLL 分频器不能通过升高来生成较低的激励频率。  

    此致、

    Cash Hao