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[参考译文] TPS543B20：在可堆叠模式下运行时输入时钟频率的上限

admin
Guru**** 2350610 points
Other Parts Discussed in Thread: TPS543B20, TPS543C20, TPS543C20EVM-869
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/981229/tps543b20-upper-limit-on-the-input-clock-freq-when-operating-in-stackable-mode

器件型号：TPS543B20
主题中讨论的其他器件： TPS543C20、 TPS543C20EVM-869

您好！

我们正在考虑在其中一种设计中以可堆叠模式使用 TPS543B20、以便利用器件的相移功能。  我们希望提供的同步频率、因为时钟的标称值为1MHz、但具有容差的频率可能略高于1MHz。  您是否知道 TPS543B20在可堆叠模式下运行时的输入时钟频率是否有上限？  数据表中列出的1MHz 值似乎是允许的最大值、但如果可能、我想确认这一点。

谢谢、

Adam

  • 0
    TI__Guru**** 2350610 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    1MHz 是数据表指定的上限、但如果高侧的时钟源高于此值~数十 kHz、我不会过于担心。 这不是硬性限制、因为该部件将不会在稍高的时钟下工作。 您必须评估您的设计以查看性能是否可接受。 如果您能够更换 IC、我建议您使用 TPS543C20EVM-869并使用 TPS543B20 IC 替换 TPS543C20 (40A 器件) IC、以使用外部时钟源评估堆叠设计条件、从而检查您的应用是否可以接受调节、瞬态、SW 抖动和稳定性等因素。

    此致、
    Kris