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[参考译文] UCC28951:SR 输出时序

Guru**** 2538960 points
Other Parts Discussed in Thread: UCC28951, UCC28950

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/979183/ucc28951-sr-output-timing

器件型号:UCC28951
主题中讨论的其他器件: UCC28950

大家好、

在下面列出的 OT/OUTF、CS 和 DCM 之间的时序是什么? 谢谢。

(1 <DCM) SR 输出关闭传播延迟

(2)当 CS>DCM 时 SR 输出打开传播延迟

此致、

查尔斯

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    您好、Charles、

    该帖子已重新分配给 PSFB 专家、 将尽快回复您。

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    您好!

    数据表的图2显示了 OUT E 和 OUT F 的时序

    当 CS 低于 DCM 阈值时、不会驱动这些输出。

    此致、

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    尊敬的 Mike:

    CS 低于 DCM 阈值与关闭 OTP/OUTF 之间的延迟时间是多少?

    此致、

      

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    您好!

    有一份应用手册在以下链接中讨论了 UCC28950。  该控制方案与 UCC28951相同。  请参阅图2、了解 E 和 F FET 的时序以及变压器的输入电流。  这比数据表更详细、应该有所帮助。

    此致、