This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] TPS65218D0:SCL 时序要求

Guru**** 2391095 points
Other Parts Discussed in Thread: TPS65218D0

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/975399/tps65218d0-scl-timing-requirement

器件型号:TPS65218D0

尊敬的  

根据第4.6章中的注释(1)、TPS65218D0数据表中规定 SCL 的占空比必须为40%@ 400kHz

i2c_omap.c Linux 驱动程序将占空比设置为@ 30%。

在本例中、我将 I2C 时钟频率降低至280kHz、使 SCL 股大于1us、如 TPS65218D0规范中所述、但占空比保持在@ 30%。

无论 SCL 频率是多少、40%的占空比是强制的?


S é bastien

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Sebastien、

    [引述 USER="Seb O"]在我的案例中、我将 I2C 时钟频率降低到280kHz、使 SCL 股大于1us、正如 TPS65218D0 规范中指定的那样、但占空比保持在@ 30%。[/引述]

    这是一种合乎逻辑和有效的方法。 所需的最短 SCL 高电平时间是1us 的常数。 在400kHz 时,这是1us*400kHz = 1us/25us = 40%,但%值随频率变化。

    以30%的占空比将时钟降低到280kHz 会导致30%/280kHz = 1.07us > 1us 的最小值,这是可接受的解决方法:-)

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    非常感谢 Brian