大家好、
“器件必须在内部为“I2C 规范中提到的”SDA 信号提供至少300ns 的保持时间。
BQ25713中是否有任何与其所需数据保持时间相关的连接?
因为一般来说、I2C 器件不会请求300ns 的最小数据保持时间。
请问 BQ25713为何要求数据保持时间延迟300ns?
BQ25713数据表:
I2C 规格:
此致、
哈迪
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您好、Hardy、
感谢您的联系。 300ns 的要求完全是由于您提到的句子。 它是为了解决一个潜在的缓慢 SCL 下降边沿时间。
"一个器件必须在内部为 SDA 信号提供一个至少为300ns 的保持时间(以 SCL 信号的 VIHmin 为基准)来桥接 SCL 下降边沿的未定义区域。"
以下是一些应用手册、供您参考、其中介绍了未定义的区域以及典型 I2C 通信中的潜在问题。 这些文章非常简短,但 对本主题的阅读非常好。
https://www.ti.com/lit/an/snoa558a/snoa558a.pdf?ts=1623693986357&ref_url=https%253A%252F%252Fwww.google.com%252F (第2页和第3页)
https://www.cypress.com/file/364871/download (请查看第2节、 可能的 I2C 问题)
使用 BQ25713时、请遵循数据表的时序要求部分。
谢谢、我希望这对您有所帮助、
Peng、
*如果我的答案解决了您的问题,请在主题中按“此已解决的我的问题”。
尊敬的 Peng:
感谢您的回复。
这是由缓慢下降导致的、然后 I2C 握手失败。 在客户的情况下、这是该总线上的单个器件、SCL 的下降时间为3ns。 您提到的问题可能与我们的情况不同。 在过去的充电器规格中、100KHz 时为300ns。 由于下面的 LL、100K-400K 的最新技术规格更改为300ns。 也许我们使用标准规格0作为最小值、这对我们的项目也很好、您是否同意? 提前感谢。
此致、
哈迪
您好、Hardy、
一般而言、这些问题是系统级决策、必须由设计人员制定并在生产测试中进行验证。 我们仅保证数据表上的规格。
I2C 的"THD:DAT"或数据保持时间是从 SCL 下降沿的低阈值端(VIL = VDD 的30%)到 SDA 下降或上升沿的开始(VDD 的70%或30%)定义的。 从屏幕截图中可以看出、这段时间大于300ns、在600ns 范围内。 对我来说还行。
谢谢、我希望这对您有所帮助、
Peng、
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