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[参考译文] UCC28070:直流输入上的乘法器设置

Guru**** 2535750 points
Other Parts Discussed in Thread: UCC28070

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1136162/ucc28070-multiplier-settings-at-dc-input

器件型号:UCC28070

您好!

UCC28070被视为三相全波整流 PFC 的电路。
我知道 UCC28070不支持直流输入、因为
IC 需要使用 VINAC 输入设置正确的乘法器电平。

但是、如下面的波形所示、我们已确认当 VINAC 始终高于0.7V 时、乘法器电平会发生变化。

CH2_Vin、CH3_VINAC、CH4_VAO

当 VINAC 超过1.65V 和1.95V 等阈值时、会发生 VAO 变化。 只有当 VINAC 从一个低值过大时、当从一个高值变为一个低值时、VAO 没有变化。

我有以下问题。

VINAC 是否必须降至0.7V 以下才能更新乘法器设置?

是否可以更新乘法器设置而不像上面的波形那样使 VINAC 降至0.7V 以下?

如果发生这种情况、请告诉我控制序列。

以下问题假设可以通过将 VINAC 降至0.7V 以下来更新乘法器设置。

是否可以通过将 VINAC 输入从外部降至0.7V 以下来设置正确的乘法器电平?

VINAC 降至0.7V 以下时、使用什么时序输入信息来更新设置?

例如、低于0.7V 之前大约2秒的信息。

 

此致。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    感谢您查询 UCC28070并分享您的观察结果。

    1. 由于这些设计用于您提到的交流输入电压、因此电压需要降至0.7V 以下以更新乘法器设置。
    2. 高于0.7V 且对于直流条件、我们尚未验证更新、并且当前没有足够的数据来证明您观察到的这种行为。 但是、我一直在尝试捕获一些数据、并认为 Qvff 将在没有过零的情况下向上更新(但不向下)。 但我们必须更多地调试这个问题、目前我没有 EVM 来调试这个问题。 我们可以尝试对此进行检查、但需要几周时间才能确认。
    3. 可以、您可以将 VINAC 降至0.7V 以下进行更新。 Qvff 电平更新取决于是否检测到输入电压波形的过零电平输入电压每半个周期变为零、 因此、检测线路电压峰值是否下降的唯一方法是使用过零指示新周期即将到来、并将下一个新峰值与旧峰值进行比较。   如果新峰值较低、则会计时较低的 Qvff 电平、并增加乘法器增益。 控制器内部的过零检测电平为0.7V。  如果您的 Qvff 从未更新、则会按照您的建议影响 IMO 电流、并且电流基准将低于最佳值、我们最终将在较低的输入电压下提供更低的功率。
    4. 您可能必须定期将 VINAC 引脚拉至接地(通常低于0.7V、持续50uS)、以触发 QVFF 表的更新以了解输入电压的变化。

    如果您有其他问题、请告知。

    此致、

    Harish

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    您好!

    感谢你的答复。  

    您的感受和我们看到的似乎匹配。  我知道您没有足够的时间进行检查。 但是、正如您所说的、如果 Qvff 意外更新到更高的值、则可能会在低输入电压下对其进行功率限制。 请尽快回复以避免此问题。

    让我再问一个问题。

    如下面的波形所示、在输入电压波动之后、VINAC 通过外部电路被拉至低于0.7V、但 Qvff 似乎不会更新。  VINAC 仅在输入电压波动后拉出一次、但为了更新 Qvff、是否需要如您在上面的4部分中所回答的那样定期拉出 VINAC?

    VINAC 通过以下波形被拉出。

    我想更新外部电路提取时序的 Qvff 电平、因此请告诉我为什么不更新。

    此致。

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    您好!

    感谢您发布详细的波形。 我认为它被下拉的持续时间是可以的、但我认为它需要 VINAC 的定期下拉来触发更新。 此外、您还需要以50-60Hz 的速率将其拉低。  我将在下周中获得 UCC28070电路板、届时我可以尝试测试此行为。

    如果您有任何疑问、请告知我们。

    此致、

    Harish

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    您好!

    您是否获得了用于 UCC28070的评估板?

    请测试以下内容。

    1.意外的向上 Qvff 更新

    即使 VINAC 被拉至0.7V 以下、Qvff 也不会更新

    此致。

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    您好!

    您能否确认上述问题?

    如果您需要任何信息、请告诉我。

    此致。

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    您好!

    感谢您跟踪查询。 e2e 网站上周已关闭、仅在今天早上才看到您的查询。 我将进行测试、但仅在本周结束或下周初更新、因为我们本周有几个法定假日。

    此致、

    Harish  

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    您好!

    我知道是时候更新了。  我还将尝试通过多次拉出 VINAC 来进行验证。 如果您可以尽快更新信息、那将非常有用。

    此致。

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    您好!

    我已经尝试拉出 VINAC 两次、并确认 Qvff 已更新。

    根据该结果、可以推断用于更新 Qvff 的 VINAC 信息是两个时序之间 VINAC 低于0.7V 时的最大周期值。  在我上次布置的波形中、当 VINAC 为2.5V 时、有一个0.7V 或更低的上拉电阻、所以两个下拉电阻时序之间的 VINAC 最大值为2.5V、我认为即使 VINAC 为低电平、它仍被设置为高电平。  这种感觉是否正确?

    即使 VINAC 未被拉至低于0.7V、Qvff 电平也会向上更新。 关于此问题、我们认为这是由于 IC 的控制方法所致、因此请回答它是否正确运行。

    此致。

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    您好!

    很抱歉耽误你的回答。

    我能够在直流条件下进行测试、以下是 Qvff 更新模式。

    启动时、 输入电压需要被下拉一次、一旦输入电压达到特定范围的边界、就会如 VAO 波形中的不连续性所示更新 Qvff。将输入电压增加到其他电平(向上)不需要将 Vinac 信号下拉至0.7V 以下。

    2.另一种方法似乎有点棘手。 假设我们处于160V 至187V 之间的电压箱中、我们希望移到下面的电压箱中。 在这种情况下、我们需要将 Vinac 两次拉至零以进行 Qvff 更新、如下图所示。

    如果您有其他问题、请告诉我。

    谢谢你

    此致、

    Harish

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    您好!

    感谢你的答复。

    请回答下面的其他问题。

    1.在不断开 VINAC 的情况下向上更新是否是 IC 设计方面的正确操作?  我知道这会在实际的机器上发生、但如果由于设计原因行为不正确、我担心是否存在其他相关问题。

    2. 正确的做法是认识到通过拉出 VINAC 两次更新的 Qvff 会根据两个拉电流时序之间的 VINAC 最大值更新到相应的电平吗?

    此致。

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    您好!

    感谢您的查询。

    1、IC 的设计非常理想、建议用于交流线路输入电压、该电压具有周期性过零功能以启用 Qvff 更新。 因此、它的目标功能是正常的。

    2.对于 Qvff 更新、假设您的工作电压与 bin 187-220V 对应、现在如果您将电压降低到160-180V bin、则 Qvff 将在两次过零后更新为新的 bin 值、直至锁存到之前的 bin 值。

    希望这对您有所帮助。

    此致、

    Harish