[参考译文] BQ24171：关于 BQ24171 ISET 端子的最大额定值

您好！

您能否发送更详细的原理图、更清晰的器件型号、注释等？ 这种分辨率使阅读文本变得困难。 此外、您能否说明当引脚上的电压降至-300mV 以下时、正在打开哪个路径或发生了什么序列？

谢谢、

Mike Emanuel

 已连接充电/放电 IC 的电路。

12.0V_IN_DC 电源12.0V、3.3V_CRG_VREF 输出3.3V。
当 Q2401-2的漏极处于关断状态且 Q2406-2的漏极也处于关断状态时、这是 TL2404 (ISET 端子)的栅极从高电平变为低电平时的波形。
(将 Q2406-1的漏极从导通状态更改为关断状态时。)

此时、ISET 引脚的电压降至-300mV 以下。

您好！

我无法理解您的逻辑。 您说什么"Q2401-2的漏极"处于关断状态？ 这是否意味着 FET 未导通？ 在这种情况下、如果 Q2401-2关断、则 Q2401-1通过上拉电阻接通、这意味着 ISET 会一直被拉至接地。 请记住、您使用12V 电压驱动它。如果 Q2406-1的栅极从高电平更改为低电平、则该 FET 会关断、但 ISET 节点仍会拉至接地。

您能否发送一个详细的列表、列出您预期会发生的情况以及每个状态下的测量电压？ 我无法理解您的计划。

谢谢、

Mike Emanuel

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打扰一下。 我犯了一个错误。

当漏极关闭时、这意味着它不会与源极导通。
当漏极导通时、这意味着它与源极导通。

 Q2401-2的漏极错误。

Q2401-2的栅极大约为3.3V、Q2401-1的栅极大约为12V。
 因此、Q2401-1的漏极处于关断状态。
Q2406-1的栅极约为3.3V、Q2406-1的漏极导通、ISET 端子与 GND 导通。 (约为0mV)

从该状态开始、Q2406-1的栅极变为大约0V、当 Q2406-1的漏极关闭时、ISET 端子的电压降至-300mV 以下。
之后、ISET 引脚的电压上升至约624mV。

您能理解吗？

您好！

如果 Q2401-2的栅极为3.3V、则其漏极导通、漏极约为0V。因此、Q2401-1的栅极实际上与 Q2401-2的漏极之间为0V、Q2401-1关断。 由于 Q2406-1的栅极为3.3V、因此其漏极导通并将 ISET 接地。 将 Q2406-1的栅极驱动为低电平将打开 FET、而 Q2406-2的行为将决定该行为。

我在阅读原理图时仍然遇到问题、因为分辨率很差。 您可以发送包含清晰文本的组件原理图吗？ 如果您关闭了 Q2401-1、Q2406-2会怎么样？ 您希望看到的最终预期电压是多少？

此外、这些电阻器/FET 与引脚的距离有多远？ 布线宽度等是多少？

谢谢、

Mike Emanuel

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我不知道如何附加文件。 请告诉我。

电路工作正常。

Q2406-2的栅极为0V、Q2406-2关闭。

从漏极到 FET Q2406-1电阻器的图形距离约为27mm。
迹线宽度是否为示波器的时间轴？
如果是这样、它处于200ns 范围内。

从0V 下降到大约-392V 并达到0V 或更高值需要大约100ns 的时间。

ISET 端子的最大额定值是否真的为-0.3V？

您能否确认 Q2401-2和 Q2401-1的操作？ 它们不能同时导通或同时关断、您已经从它们中制作了一个逆变器。 它们的状态是相反的。

我认为您无法附加文件。 请插入具有更高分辨率的图像。 请在上传后再次检查您的帖子、以确保所有文本可见。

布线宽度是指从引脚到电阻器/FET 的铜路径上的宽度。 您提供的27mm 是布线长度、这是引脚与电阻器/FET 之间沿铜线的距离。

我需要一个非常清晰的表格、其中详细说明了 FET 的感应状态(输入)、后续节点的预期结果(预期输出)以及后续节点的实际结果(实际输出)。 我不理解您尝试执行的操作的逻辑；掌握这些信息将帮助我调试电路。

是的、ISET 的绝对最大额定值为-0.3V。这并不意味着该引脚将阻止其自身低于该电压。 诱导芯片使 ISET 引脚低于这个电压违反了最大额定值并且有可能对芯片造成永久损坏。

谢谢、

Mike Emanuel

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2401-2 FET 导通、Q2401-1 FET 关断。
我将再次附加原理图。

最小布线宽度为0.1mm。

这是一个时序图。

无法附加高分辨率图像。

您好！

我真的需要更高分辨率的图像、以便我可以看到您正在使用的电阻器和晶体管。 我通常使用 Microsoft Windows 中的切断工具、该工具有效。

此外、我不理解您提供的操作表。 两种状态下的晶体管完全相同、但产生的结果不同。

谢谢、

Mike Emanuel