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[参考译文] UCC28951-Q1:了解 ADELEF 和变压器短路

Guru**** 2538960 points
Other Parts Discussed in Thread: UCC28951-Q1, UCC28951

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1162145/ucc28951-q1-understanding-adelef-and-transformer-shortcircuiting

器件型号:UCC28951-Q1
主题中讨论的其他器件: UCC28951

您好!

我正在调查 TIDM-020031并在 UCC28951-Q1上工作。

请参阅基于  TIDM-020031的原理图。 它是 PSFB CDR。 变压器次级绕组只有一个绕组和 SR。

考虑 CCM 运行

1) 1) IC 具有 ADELEF 引脚。 它设置 OUTA 或 OUTB 关断与 OUT-E 和 OUT-F 关断之间的延迟时间。 用户为什么需要此死区?  使用此死区在拓扑中取得了哪些成就?

2) 2) IC 如何在同步整流器 MOSFET 上实现 ZVS? 是否通过同时对变压器的初级绕组和次级绕组短路来实现?

3) 3)存在一个间隔、即变压器的初级绕组和次级绕组都由 MOSFET 短路。 这样做的目的是什么? 拓扑是否使用变压器中存储的电流为 MOSFET 的余弦充电?

4) 4)您能否提供任何其他文档来了解使用  ADELEF 的操作 ?

提前感谢您。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    1. 正确的方法是使用 ADELEF 引脚在 QA 关断时延迟 FET QF、在 QB 关断时延迟 FET QE 关断。  数据表的图31中显示了这种情况。  其原理是通过调整 ADELF 时序来减少 FET QE 和 QF 的体二极管导通。

    2. 移相全桥仅在初级 FET 上具有 ZVS、而不是次级整流器。

    3. 正确的做法是,次级侧的 SR FET 可以在续流期间同时导通。  当时、定义该器件的系统工程师认为这有助于降低次级侧的传导损耗。  然而、当 SR 从续流中流出时、它确实减少了次级侧的体二极管导通。  在600W 设计中、这使效率提高了大约0.5%。  因此、系统工程师决定将此功能保留在控制器中。

    4.当涉及到 ADELEF TAFSET 和 TBESET 时、应将 A、B、C 和 D 之间的导通延迟设置为1/2。 这可确保在相移全桥的初级到次级传输能量时 SR 处于开启状态。  以下链接将为您提供一份应用手册、其中介绍了如何在相移全桥中设计 UCC28951。  在第13节中、应用手册回顾了如何设置 FET A、B、C、D、E 和 F 的导通延迟时序。 公式138至144详细介绍了如何设置 ADELEF 和 Delef 的时序。

    https://www.ti.com/lit/an/slua560d/slua560d.pdf

    此致、