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[参考译文] TPSM53603:有问题的设计

Guru**** 2513185 points
Other Parts Discussed in Thread: TPSM53602, TPSM53603

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/891991/tpsm53603-design-in-questions

器件型号:TPSM53603
主题中讨论的其他器件:TPSM53602

尊敬的*:

有关 TPSM53602的几个问题、Vin=12V 至24V、Vout=5V、Iout、eff ~ 1.5A

1) 1) V5V 引脚13的去耦电容器

- DS 中没有信息

-在 EVM 中 有一个未组装的封装

-在 WEBENCH 中有一个1uF 电容器

1A)是否建议在 V5V 引脚上使用此电容器?

1b)建议值是多少?

1C)是否需要该引脚以 AGND 或 PGND 为基准?

2)反馈电阻器

-建议使用10kOhm 的上电阻器

2A)我们是否可以将该电阻器更改为4k99?

2b)如果该电阻器的值大于或小于10kOhm、则有什么缺点?

3)建议的最小 Cin (2x 10uF)和 Cout (表1)

3A) Cin 和 Cout 是否有最大限制?

3B)在 DS " 中添加高于 COUT (min)的附加电容时、电容可以是陶瓷型、低 ESR 聚合物型或两者的组合。"

输出是否也可以是陶瓷+低 ESR 钽电容器的组合、例如 TPSD157K010R0050 ( 10V 150uF 10% 2917 ESR= 50m Ω)?

3c)允许的最大 ERS 是多少? 此外、如果我们  并联2个 TPSD157K010R0050、则有效 ESR 更低、这更好?

https://e2e.ti.com/blogs_/b/powerhouse/archive/2019/09/17/options-for-reducing-the-mlcc-count-for-dc-dc-switching-regulators

3d)我们应在多大频率下观察 ESR? 因为在大多数 DS 规格中为@ 100kHz。

4) 4) 4)您能否提供用于计算 UVLO 的公式?

此致。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    我对您在以下问题提供了意见:

    1A。 功能方框图显示了器件内部有一个内部去耦电容器。 具有额外的去耦电容器可能有利于 V5V、但这不是必需的。

    1b。 如果您想将该1uF 电容器包含在原理图中、可以使用 WEBENCH 设计中详述的电容器。

    1c. 请将其参考 AGND、因为它是噪声较小的接地平面。  

    2A。 是的、您可以选择所需的任何电阻器组合值。  

    2b. 使用较低电阻值的缺点是它会拉取更多电流。 电阻越大、它就越有可能受到噪声的影响。 电阻器越低、其消耗的输出电流就越大。

    3A。 有关 Cin 和 Cout 的限制、请参阅第6.3节。

    3b. 是的、这应该可以。 通常、数据表将需要最小的陶瓷输出电容器来帮助减少输出电压纹波。 之后的任何输出电容都可以是全陶瓷电容、也可以是陶瓷电容和极化电容的组合。

    3c 没有最大 ESR、建议越低越好。 实际上、如果您将陶瓷电容器与钽电容器并联、则并联的 ESR 相对较低。  

    3D。 如果100kHz 是 DS 限制、那么我将坚持这一要求。 博客中引用的图表显示了不同电容器类型之间的 ESR 比较。 对于 TPSM53603情况、您将在1.4MHz 下运行、而低频下 MLCC ESR 的问题变得微不足道。

    UVLO 的公式只是一个分压器公式、用于将使使使使使使使能电压达到1.23V 的电平、从而开始开关。 公式如下所示:

    • R_ENb = 1.23V *(R_ent)/(Vin_UVLO - 1.23V)  

    如果您需要其他信息、请告诉我。

    此致、

    Jimmy

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    尊敬的 Jimmy:

    1)

    我将查看您的 UVLO 公式、它对应于 DS 中的值

    对于10V UVLO、顶部电阻为100k、底部电阻为14k。

    但我也尝试过 WEBENCH,当我启用 UVLO 电压计算并将其设置为10V 时,WEBENCH 输出顶部电阻100k 和底部732k? WEBENCH 中是否存在错误?

    https://webench.ti.com/power-designer/switching-regulator/customize/271?AppType=None&Flavor=None&O1I=3&O1V=5&Topology=BUCK&VinMax=24.00&VinMin=12&VoltageOption=None&base_pn=TPSM53603&flavor=None〈_chosen=en_US&op_TA=30&optfactor=3&origin=pf_panel

    2) 2) DS 中的最小 Cin 指定为最小陶瓷20uF

    2a)是否包含降额的有效值?

    2B)在 WEBENCH 中仅显示2个2.2uF GRM31CR61H225KA88L??

    此致。

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    您好!

    1.感谢您提请我注意这一点。 我已经确认 WEBENCH 设计确实显示了100k 顶部和732k 底部、我将标记并立即通知 WEBENCH 支持团队。

    2A。 20uF 是2 x 10uF 的典型值。 我建议为输入使用1210或0805外壳尺寸陶瓷电容器、以便在24V 降额后、您仍然具有一些输入电容。

    2b. 我将再次通知支持团队此错误。 一定会出现一些连接问题、导致选择该异常低的输入电容器。

    此致、

    Jimmy