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[参考译文] TPS65023：申请帮助以查看使用 TPS65023RSBTG4的原理图设计

admin
Guru**** 2387080 points
Other Parts Discussed in Thread: LM3881, TPS65023
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/927500/tps65023-request-help-to-review-schematic-design-using-tps65023rsbtg4

器件型号：TPS65023
主题中讨论的其他器件：LM3881、

尊敬的 TI：

我目前正在使用 TPS65023RSBTG4设计具有加电序列的电源。 原理图如下所示。

您能否查看设计是否正确？ 谢谢。

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    TI__Guru**** 2387080 points
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    您好！

    此主题已分配给支持此器件的应用工程师。  

    请您再次上传设计。 上载文件时似乎出现问题。

    此致、
    伊凡  

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    TI__Guru**** 2387080 points
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    您好！

    请查看下面显示的原理图(粘贴在此文本框中)。 谢谢。

    如果图像不可见、是否有上传图像文件的链接？

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    TI__Guru**** 2387080 points
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    图像不可见。

    在文本编辑器中、您需要单击回形针符号(如果将鼠标悬停在上方、则显示"插入文件")以附加 PDF 或其他文件类型、或者单击 Image+符号(如果将鼠标悬停在上方、则显示"插入/编辑媒体")以在邮件正文中插入图像(.PNG、.JPEG、.GIF)。

    下图突出显示了这两个符号、该图使用  Image+ 符号插入到"插入/编辑媒体"中、并添加了保存在我的 PC 上的.PNG 屏幕截图。

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    TI__Guru**** 2387080 points
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    大家好、我插入了图像文件。 请您评论一下吗？ 谢谢。

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    TI__Guru**** 2387080 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    是的，现在我可以看到图像了，我将查看并提供反馈:-)

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    TI__Guru**** 2387080 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    以下是我根据 TPS65023x 原理图检查清单 文档提供的反馈：

    • 即使未使用 VRTC、建议在 VRTC 引脚与 GND 之间"至少连接100nF 电容"
    • 如果未使用 PWRFAILz 输出(悬空)、则  PWRFAIL_SNS  输入 应连接到 GND
    • 如果不使用 LOW_Batz 输出(悬空)、则应将 LOWBAT_SNS 输入连接到 GND
    • 无法看到连接到 SCLK (FPGA_SCL)和 SDAT (FPGA_SDA)引脚的上拉电阻器-应为1k Ω 至10k Ω
    • 无法看到控制 EN_DCDC1-3输入以确保所需序列时序的 Flag1-3信号源。 1 = DCDC2、序列。 2 = DCDC3、序列。 3 = DCDC1
    • 由于两个 LDO 均未使用、因此您可以将 LDO1和 LDO2引脚直接连接到 GND (与 VIN_LDO 相同)

    您可以参考我为您启动的附带的清单文件。

    e2e.ti.com/.../TPS65023_5F00_CHKLST_5F00_2020_2D00_08_2D00_03.xlsx

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    TI__Guru**** 2387080 points
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    谢谢 Brian。

    您能否使用下面显示的 LM3881查看功率序列原理图？

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    TI__Guru**** 2387080 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    • DCDC1_EN = FLAG3 =序列#3
    • DCDC2_EN =标志1 =序列#1
    • DCDC3_EN = FLAG2 =序列#2

    结果：当 LM3881的 EN 引脚大于1.22V (t0)时、序列发生器将开始运行。 由于 INV = GND (低电平)、FLAGx 输出为高电平有效、这是控制 TPS65023 PMIC 的正确方法。

    1. 1.0V (DCDC2)将由 Flag1在时间 t0 + TD1处启用
    2. 1.8V (DCDC3)将由 FLAG2在时间 t0 + TD1 + TD2时启用
    3. 1.5V (DCDC1)将由 FLAG3在时间 t0 + TD1 + TD2 + TD3时启用

    T_ENABLE_DELAY = 1.22V * CEN / 7uA = 0、因为 EN 引脚上没有电容器在启动期间产生 RC 延迟。 当"+3.3V"网络> 1.2V 时、序列发生器将启动。

    图像很难读取、但 TADJ 引脚 C390上的电容器的值看起来是0.0047uF

    TADJ、周期= 120US/nF*0.0047uF = 0.564ms

    TD1 = 9*0.564ms = 5.076ms 最小值、10*0.564ms = 5.64ms 最大值

    TD2、TD3 = 8*0.564ms = 4.512ms 典型值

    这些是 LM3881在您的系统中实现的序列顺序和时序参数。

    由于我不知道为 TPS65023器件供电的 FPGA、因此您需要确定序列时序和顺序是否满足 FPGA 的定序要求。

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    TI__Guru**** 2387080 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好 Brian、非常感谢您的评论。