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[参考译文] TPS7A49:SENSE 线/连接

Guru**** 1831610 points
Other Parts Discussed in Thread: TPS7A30-49EVM-567, TPS7A49
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/762710/tps7a49-sense-wire-connection

器件型号:TPS7A49
主题中讨论的其他器件:TPS7A30-49EVM-567

您能否使用感测线路确认正确配置。 感应线路似乎应在受电电路的位置(电源入口点)与稳压输出接触。 您能确认一下吗?
此外、对于称为 CFF 10nF 的电容器而言、最佳位置也是如此。

我提出这一问题是因为您的评估板将感应线路连接到实际电路板上的输出电压、而不是提供 V OUT /GND OUT 和感应 OUT。 这大概是为了方便起见、并不是配置器件的最佳方法。

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    您好 Richard、

    正确的 TPS7A30-49EVM-567不像我们较新的 EVM 那样提供检测测试点。  为了更好地向客户展示解决方案尺寸、此特定 EVM 在整个 LDO 解决方案周围有一个丝印盒。  通常、LDO 放置在其负载的本地、其解决方案尺寸与丝印盒类似、而不是完整的 EVM。

    LDO 输出本地感测测试点的优势在于、您的测量不会包括由 Vout 平面中的电阻引起的压降。  在应用中、您可以通过将反馈网络放置在更靠近负载的位置来解决这种压降中的某些问题;但是、反馈网络连接必须先于任何铁氧体 磁珠或电感器。

    与 EVM 一样、我们通常建议将前馈电容器放置在反馈网络电阻分压器的顶部电阻旁边。

    非常尊重、

    Ryan

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    您好、Ryan、感谢您的回复。 这似乎是最佳布局、包括感应线路的单独路径、但未显示 CFF。 您想将其与 R1并联吗?

    我昨天注意到、电路对感测线路从电路板上走出来的长度和路径有多敏感。 我倾向于将其随 Vout 和 GND 一起发送到一根短屏蔽电缆上。

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    您好 Richard、

    感谢你的答复。  对于您所提到的布局示例有误、我深表歉意。  在图37中、"感测线路" 被路由至 Cout 下方的 R1、并且被连接至靠近负载但在任何大电感之前的 Vout。  将 R1连接到更靠近负载的 Vout 的目的是可以减小由于 Vout 平面电阻而导致的压降;但是、为了实现稳定性、必须最大限度地减小 LDO 控制环路内的任何电感。

    电阻分压器和"感测线路"是 LDO 反馈环路的主要部分。  内部误差放大器驱动通流器件、以便由电阻器分压的输出电压等于内部基准电压。  反馈环路中拾取的任何噪声都会影响输出电压。  

    是的、CFF 将与 R1并联。

    非常尊重、

    Ryan

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    您好、Ryan
    您没有误解我、因此无需道歉。 EVM 是我订购用于评估器件的器件、第二个布局看起来更先进。 现在、我正在考虑进行我自己的 PCB 布局。 唯一的问题是、如果直接连接到负载的感应线路的唯一优势是降低压降、 然后、如果稳定性和噪声是我的关键标准、我应该只将 V SENSE 连接到最接近器件的输出。

    实际电压变化是次要考虑因素(稳态)。
    我可能误解了将 V Sense 直接连接到负载的好处、认为它可以补偿负载处拾取的噪声。 最好的解决方案似乎是无论如何并置寄存器和负载。

    祝 Richard 一切顺利
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    您好 Richard、

    我关于 TPS7A49 (或任何 LDO)布局的建议与 EVM 更相似。  下面我用红色圈出了负载的理想位置。  这样、反馈网络就能接近负载、并最大限度地减少会对 LDO 性能产生不利影响的任何寄生、从而使您受益。  负载可能也会有自己的无源组件、但主要的想法是将 LDO 放置在尽可能靠近负载的位置、以实现最佳性能。

    非常尊重、

    Ryan