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[参考译文] TPS767D3:断电期间的 TPS767D318复位问题

Guru**** 1142300 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/634341/tps767d3-tps767d318-reset-question-during-power-down

器件型号:TPS767D3

LDO 专家、您好!

我遇到有关 TPS767D318的问题、您可以看到以下原理图、客户犯了错误-将 res1.8V 连接到 DVCC_3.3。

客户知道这不是正确的设计、他们将在下一版本设计中进行修改。

但基于此设计、我们找到了有关 res_1.8的有趣测试结果、您可以找到如下所示的测试波形。

测试条件:

当 VIN 5V 开始断电时、监测 DVCC3.3和 Res_3.3以及 DVCC1.8和 Res_1.8。

从测试波形可以看出、DVCC3.3首先下降、当 DVCC3.3低于3.16V 时、res_3.3变为逻辑"低电平"。

此外、您还可以看到、在 DVCC1.8开始下降之前、res_1.8下降到 DVCC3.3 (这是有道理的、因为 res_1.8被上拉至 DVCC3.3)。

但是、您可以看到 res_1.8随后在 DVCC1.8开始下降之前变为逻辑"低电平"。 您能帮助您对此测试结果发表意见吗? 为什么?


此致

IVEN XU

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    Iven、您好!

    一旦5V VIN 断电、用于控制逻辑的内部电路也可能被关断。 一旦 Vin 被移除、逻辑就会进入未定义的区域、并且这些行为不会被指定。

    此致、
    Jason
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    您好 Jason、

    感谢您的反馈、这是基于您的意见。

    但是、为什么3.3V REST 内部控制逻辑根据测试资源看起来正常工作、我已经检查了这个部件的方框图。

    我们可以看到、在1.8V 开始断电之前、这意味着内部 LDO 可用于该通道、您可以看到复位控制逻辑电路也由相同的输入电压供电、因此我的理解是当输入电压开始断电时、 现在、它看起来3.3.3V 输出首先断电、复位3.3逻辑仍然有效(因为可能 Vin 不会降至很低、控制逻辑仍适用于3.3V 通道)。

     此时1.8V 仍然工作、看起来复位1.8V 逻辑仍然工作(根据我们的测试结果)、然后 Vin 仍然保持下降(可能下降到某些值)、然后关闭 loigc 1.8V (但从我们的测试结果中可以看到、 当复位1.8开始降至逻辑"低电平"时、1.8V LDO 仍然工作、因此我无法理解为什么1.8V 逻辑会分流而1.8V LDO 仍然工作?)

    可能需要您的帮助才能与设计人员进行联系、谢谢。

    同时、您能否帮助检查第3页的复位最小输入以实现有效复位?

    此致

    徐文

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    Iven、您好!

    您是否能够提供有关5V VIN 行为的屏幕截图? 对于"有效/复位的最小输入电压"、它仅是典型值、让我检查一下我们是否在温度范围内收集了任何数据。

    同时、您是否还能帮助我了解在 Vin 已关闭的情况下、让他们拥有正确的逻辑为何很重要?

    此致、
    Jason Song
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    您好 Jason、

    1、很抱歉目前无法进行进一步测试。

    2、  Win 已关闭时、他们不需要正确的逻辑、 客户 需要 在 Vout_3.3或1.8V 下拉至某个值时使用复位逻辑。

    因此 、如果 Vin 开始下拉并下拉至某个值、则应 开始下降 Vout_3.3或1.8V、因此客户认为当3.3V 或1.8V 输出下拉至某个值时、复位逻辑应该起作用、对吧?

    此致

    徐文

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    Iven、您好!

    我明白你的观点。 根据您提供的屏幕截图、当1.8V Vin 仍然存在时、如果1.8V 输出的 Vin 仍然超过 RST 逻辑的最小 Vin、通常1.8V 输出的/RST 信号不应下降。 但是、如果不在同一个图上显示 LDO 的两个输入的行为、我们很难知道是什么导致了/RST 引脚的这种异常行为。  

    此致、  
    Jason Song

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    Iven、您好!

    考虑到/RST 引脚上的200ms 延迟、当您进行新的屏幕截图时、您是否可以在/RST 信号下降后在图中包含不小于200ms 的延迟? 这肯定会对我们有所帮助。

    此致、
    Jason Song