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[参考译文] TPS62067:高侧 FET 的导通延迟可能会定期约为100ns

Guru**** 2386620 points
Other Parts Discussed in Thread: TPS62097, TPS62822, TPS62065, TPS62067
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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/657603/tps62067-maybe-periodically-about-100ns-turn-on-delay-for-the-high-side-fet

器件型号:TPS62067
主题中讨论的其他器件:TPS62097TPS62822TPS62065

大家好、团队成员

客户询问如何减少输出纹波。

因此、我要求在某些关键点发送工作波形。

随附的 SW 引脚波形被发送用于出现输出纹波问题的样本。

高侧开关导通延迟约为100ns。

有哪些问题?

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    您好、Yoshwa - San、

    没有附件。

    这是一个非常旧的器件、不允许使用大/强输出滤波器。 较新的2A 器件通常具有较低的纹波、包括 TPS62097和 TPS62822。
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    Chris Sann、

    感谢您的快速响应。

    我连接了波形。

     

    Yoshifusa Wada

    e2e.ti.com/.../TPS62067-SW_2D00_pin-issued-sample.pdf

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    感谢您的发送、但这是 SW 节点的波形。 我认为报告的问题是输出纹波?

    该波形中使用了什么 Vin、Vout、Iout? 这是在一个器件/电路板上还是在所有电路板上发生? 它是周期性的还是随机的(很少发生)?
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    仅发送所附的3.3V 输出波形。

    VIN 为5.0V、3.3V 负载电流约为200mA 至300mA。

    L=1.2uH、

    COUT=22uF + 10pF、

    Cin=10uF

    您能否仅根据此数据估算问题?

     

    客户将使用 PWM 模式来最大程度地降低输出电压纹波。

    他已经在100mA 和0.5A 负载条件下使用自己的电路板确认了小纹波特性。

    e2e.ti.com/.../TPS62067-3_5F00_3VOUT-ripple.pdf

    e2e.ti.com/.../TPS62067-33-ohm-load.pdf

    日本 CS Yoshifusa Wada

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    您好、Wada-San、

    感谢您的发送。

    TPS62067没有强制 PWM 模式选项。 他是否会使用 TPS62067或 TPS62065? 我建议使用较新的器件、如 TPS62097。

    最新波形显示的是 PFM 模式、而不是强制 PWM 模式。

    这些较轻的负载接近 PFM/PWM 边界。

    FB 电阻器值是多少?

    他能否使用推荐的1 μ H 线圈进行测试?
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    Chris Sann、

    非常感谢您的评论。

    我已将您推荐的 TPS62097转给客户。

    但是、由于直接更换、客户正在考虑更换到 TPS62065。

    TPS62067是我的错误。

    不、他没有测试1 μ H。

    对于3.3V OUT、FB 电阻器为150千欧和680千欧。

    此致、

    Yoshifusa Wada