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[参考译文] LP87332A-Q1：J6Entry 用于 PMIC 电源 LP87332A

admin
Guru**** 665180 points
Other Parts Discussed in Thread: LP873220-Q1, LP87332D-Q1, LP873220, TPS51200, LP87332D, LP8732-Q1, LP8733-Q1
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/708325/lp87332a-q1-j6entry-for-pmic-power-lp87332a

器件型号：LP87332A-Q1
主题中讨论的其他器件：LP873220-Q1、 LP87332D-Q1、 LP873220、 TPS51200、 LP87332D、 LP8732-Q1、 LP8733-Q1

尊敬的：

 LP87332D-Q1 和 LP873220-Q1。 所有 输出电压都是正常 的、我们 遵循上电顺序。

 

但我们对 EN_TPS51200 (LP873220_GPO2)和 SW_3V3 (LP87332D_GPO) PORz 进行了微调

 

(LP87332D_GPO2)、(LP873220_GPO)以及   PGOOD 是 相同 的0V。

 

 GPIO`s 什么情况？ `s 设置模式选择？

 

如有任何建议、请告知我。

 

谢谢、

 

此致、

 

劳伦斯。

 

作为原理图。

e2e.ti.com/.../1004.nu100_5F00_20180419_2D00_core_2D00_TI.pdf

  


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    TI__Guru**** 665180 points
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    您好、Lawrence、

    GPO/GPO2和 PORz 引脚是开漏信号。 看起来 PMIC_Regen_DDR 信号上的唯一上拉电阻器是 VSW_3V3。 但 Regen_DDR 是 VSW_3V3开关的使能信号。 因此、我预计 VSW_3V3未处于活动状态、因此 PMIC_Regen_DDR 信号没有上拉域。

    我建议您修改 PMIC_Regen_DDR 信号、以便使用10k 电阻器上拉至 VSYS_3V3。 请告诉我这是否能解决您的问题。

    此致、
    Karl
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    TI__Guru**** 665180 points
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    大家好、Karl、

    我有与劳伦斯相同的问题。

    感谢您的建议。 上拉 PMIC_Regen_DDR 信号后、信号正确。

    但我有一个新问题、J6条目无法从 SD 卡引导(QSPI 和 eMMC 均为空)、UART1 TX 上没有任何消息。

    我的状态是

    a.为 J6Entry 供电的 LP8733-Q1和 LP8732-Q1加电序列用户指南图2.

    b. SD 卡中的引导加载程序(518202 J6入门级 EVM 板版本)。

    c. Choice SYSBOOT[5：0]= 0b100010 => SD 引导。

    d.在 J6入口使用19.2MHz 晶体，sysboot[9：8]= 0b11 (19.2MHz 为518392 J6入口低 REF 版本)。

    e.复位信号(PORz)为高电平。

    我们尝试将引导加载程序更改为518392 J6低 REF 版本(从 Web 下载)、但 UART 上仍然没有任何消息。

    (下载518392加载程序可能不正确。)

    请问您该怎么办？

    非常感谢。

    Ryan。
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    TI__Guru**** 665180 points
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    您好、Ryan、

    我很高兴您的第一个问题得到解决。

    您能否使用"提出新问题"按钮发布器件型号为 DRA71x 的新主题、或您使用的器件型号是什么？ 由于您的问题与处理器启动有关、而不是电源解决方案有关、因此这会将您的问题发送给 J6入门团队、他们可以更好地帮助您。

    谢谢、
    Karl