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[参考译文] TPS65642A:有关上电序列 VGHM 的问题延迟至 VGH、时间不同

Guru**** 2390730 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/689843/tps65642a-question-about-power--up-sequence-vghm-is-delayed-to-vgh-not-same-time

器件型号:TPS65642A

大家好、  

客户实验更改 VGH-VGHM 上的电容值、howerver 无上电序列更改。 请告诉我为什么没有更改、请参阅附件。

此致、Naoki yada

e2e.ti.com/.../TPS65642A-Questoins_5F00_20180516.xlsx

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    Naoki-San、您好!

    有2个点会影响 VGHM 启动。 从 VGH 到 VGHM 的内部延迟由 DLY6寄存器设置、默认设置为20ms。 当 VGH 处于目标值时、您需要将该寄存器设置为0ms (0x00)以直接启动 VGHM。

    此外、为了将 VGHM 连接到 VGH、FLK 信号需要为高电平(打开图5-9中的 Q1)。

    我希望客户测量的54ms 是 DLY6寄存器和 FLK 信号的组合、因为寄存器可以设置的最大延迟为35mS。

    此致、
    Brigitte
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    您好、Brigitte、
    那么、在 VGH 启动后、如果 FLK 变为高电平、VGHM 立即启动、对吧?
    此致、NY
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    Yada-San、您好!

    请原谅延迟的回复。
    如果 VGH 已启动、则当 VGH 变为高电平时、它取决于 DLY6寄存器的设置。 有关10ms 延迟、请参阅数据表中的图4-60。
    此时、FLK 可能为高电平、但在 DLY6通过之前、VGHM 不会变为高电平。

    此致、
    Brigitte
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    Hellow Brigitte-San、

    这是 Kurioka @ Sharp。
    我是 Yada 先生介绍的人。

    感谢你的答复。

    总之、在 VGHM 中、VGH 在 DLY6的设定时间和 FLK 信号生成时间之后上升和上升。
    这种认可是否正确?

    此致、
    库里冈
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    Kurioka-San、您好!

    请查看此图:

    对于该启动测量、FLK 始终为高电平。 VGH 达到设定值大约10ms 后、VGHM 启动、因为 tDLY6设为10ms。

    VGHM 在发生以下情况后变为高电平:
    1. VGH 达到设定值后、tDLY6时间已过。
    2. FLK 为高电平。

    也许数据表第35页的这段文本有助于更好地了解行为:

    此致、

    Brigitte

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    您好 Brigitte - San、

    感谢您的详细解释。

    我明白了。

    谢谢你。

    此致、

    库里冈