[参考译文] LP8764-Q1：器件通过中断供电

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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1229025/lp8764-q1-part-powers-with-interrupts

器件型号：LP8764-Q1

我的设计通过中断上电。通常、设计会简洁明了、不会发生任何中断。

这可能是什么原因?

我已将 GPIO4配置为启用。 GPIO4的置位和 DE 置位是否会自动转换为 SU_ACTIVE =高电平和 SU_ACTIVE =低电平？

11 个月前

0 admin 11 个月前

TI__Guru**** 666710 points

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您好、Bala、

如果寄存器字段 StarTOP_DEST 设置为"11"、则有效的开启请求事件(例如在 ENABLE 引脚上)会导致 PFSM 中的 SU_ACTIVE 触发器。

此致、

弗洛里安

0 admin 11 个月前

TI__Guru**** 666710 points

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谢谢 Florian

是的、我的设计将 StarTOP_DEST 设置为2'b11。

我已将使能极性设置为逻辑高电平

因此、如果 GPIO4 (Enable)= 1'b1、SU_ACTIVE 将为真。

如果我切换 GPIO4 (ENABLE)= 1'b0、是否会导致 FORCE_STANDBY =高电平？在这种情况下、SU_ACTIVE 的状态是什么？

另外，中断又如何呢？请阅读"我喜欢看到设计在启动期间干净而不会出现任何中断"、我们如何确保启动期间没有错误或错误中断？

我仍然无法将文件附加到这些问题中。

谢谢

巴拉

0 admin 11 个月前

TI__Guru**** 666710 points

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您好、Bala、

SU_ACTIVE 没有状态。这是发送到 PFSM 的触发器、用于启动状态转换、从而执行电源序列。因此、设置 Enable 引脚为高电平将导致向 PFSM 发送 SU_ACTIVE 触发器、而将其设置为低电平不会对 SU_ACTIVE 触发器执行任何操作。另一方面、将 Enable 引脚设置为低电平将导致向 PFSM 发送 FORCE_STANDBY 触发信号。

请阅读表8-5。 PFSM 触发条件选择和8.4.2.3任务状态配置、包括8.4.2.4.1 ON 请求和8.4.2.4.2 OFF 请求、以了解更多信息。

此致、

弗洛里安

电源管理（参考译文帖）

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