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器件型号：TPS563200 大家好、
我们使用 Webench 设计出了一个12V2A 至5V3A 的电路板。
在我们开始测试组装的 PCB 时、我们注意到、即使最小负载为5V3A、IC 也会损坏。
下面是 Webench 建议的原理图、我们已实施了相同的原理图。
我们需要您的专业知识来解决设计问题。
此致、
Sadashivan
大家好、
我们使用 Webench 设计出了一个12V2A 至5V3A 的电路板。
在我们开始测试组装的 PCB 时、我们注意到、即使最小负载为5V3A、IC 也会损坏。
下面是 Webench 建议的原理图、我们已实施了相同的原理图。
我们需要您的专业知识来解决设计问题。
此致、
Sadashivan
尊敬的 Sadashivan：
对于 FET 短路情况、MOSFET 上通常存在电压应力、并且可能与布局相关。
原理图看起来很好。 关于布局、GND 引脚应覆盖较大的铜岛、而不是单迹线。
这可能会导致 GND 布线上出现较大的寄生电感、并且当高侧 FET 导通时 SW 将产生高振铃。
您可以使用全带宽探头检查 SW 波形、以查看尖峰是否有电压超过19V 的风险。
要修改布局、您应遵循我们的数据表、尤其是输入和 GND。
