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[参考译文] UCC14240-Q1:VDD VEE 设置为18V,但电阻器容差将其设置为较低的18V

Guru**** 1138100 points
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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1345463/ucc14240-q1-vdd-vee-set-to-18v-but-resistor-tolerance-have-it-lower-18v

器件型号:UCC14240-Q1

大家好、

针对栅极驱动器偏置、客户希望将 VDD VEE 设置为18V。 但是、当典型电阻值设置为18V 时、由于电阻器的容差、该电阻器值可能会使其低于18V。 该器件的行为是什么? 如果栅极驱动器可接受17.x V 电压、器件是否可接受?

此致、

林市

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    你好,Hayashi。

    没问题。 此器件能够处理略低于(VDD - VEE)的值、此值小于18V。

    谢谢!

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    您好、Manuel:

    器件可以处理的更高电流。 输出电压会是多少? 它是稍低还是钳位至18V? 我希望限制来自变压器比、以便它生成的电压会略低于18V?

    此致、

    林市

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    尊敬的 Hideki:

    只要输入电压在21V<Vin<27V 的范围内、输出电压(VDD VEE)就将为18V 或略低。

    谢谢!