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[参考译文] LM61460：关于 PG 抗尖峰脉冲时间

admin
Guru**** 2406780 points
Other Parts Discussed in Thread: LM61460, LMR33630, LM61460-Q1

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1217856/lm61460-about-pg-deglitch-time

器件型号：LM61460
主题中讨论的其他器件： LMR33630、

您好！

我感到困惑为什么6A LM61460 PG 抗尖峰脉冲时间远低于 LMR3352的 PG 抗尖峰脉冲时间？ 为什么 LM61460的上升抗尖峰脉冲时间远高于 LMR33630？ 有什么注意事项吗？ 我认为它对实际上电或复位没有影响。 谢谢！

LMR33630 60-170us 的 PG 上升和下降时间

LM61460上升2ms、下降120us

-A

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    TI__Guru**** 2406780 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好！

    我认为这对上电或复位没有任何影响。 LM61460具有以下 PGOOD 时序图。 T_PGDFLT (rise)的 时间更长、仅用于确保输出电压在一段时间内保持稳定。 然后 PGOOD 标志将拉高、以指示其正在调节中。  

    LM61460-Q1 PGOOD 时序图

    该设计原本希望在此 IC 中实现、但实际上并没有在 LMR33630中实现如此长的延迟。  

    请注意、LMR33630的电源正常时序行为是 输出电压达到95%的 Vout 且 PG 立即上拉时的行为。  

    也许这里的问题是、您想要的是在 VOUT 达到95%的调节 点时具有 PG 上拉电阻的 IC、还是在 VOUT 被调节到最终的输出电压点时具有 PG 上拉电阻的 IC。  

    此致、

    吉米