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你好
我根据 WEBENCH 设计原理图。 但我发现输出电压过大。 图片是输出电压的波形。 高侧 MOS 导通时、似乎会出现较大的纹波。 电感值太小或由于其他原因
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我根据 WEBENCH 设计原理图。 但我发现输出电压过大。 图片是输出电压的波形。 高侧 MOS 导通时、似乎会出现较大的纹波。 电感值太小或由于其他原因
输出电压的示波器波形中出现的大阶跃有2种可能的来源:
1) 1)它是来自以下任一来源的测量误差:
电感器磁通的接地环路拾取、在示波器接地线夹环路中感应电流
探头接地和示波器公共接地总线之间的接地至接地错误、原因是多个探头接地连接到同一电路板、或另一个"接地"接地参考连接到电路板、而不是示波器的接地总线。
这两种测量误差都可以向 VOUT 测量添加一个与高侧 FET 开关相对应的"阶跃"函数。 通过在探头周围扭曲接地线夹、使用弹簧线圈和探头的接地筒进行"尖端和接地筒"测量来减小接地环路面积、从而更大限度地减小接地环路面积、使探头远离电感器、 移除电路板上的其他示波器探头或接地参考都有助于消除这些可能的来源。
2) 2)这是对电感器和输出电容器的 ESL 及其布局之间的电感分压器所产生的输出电压的真实测量。
这种实际源通常通过改进输出电容器的布局来减少、从而更大限度地降低寄生电感。 添加接地过孔、将顶部电容器镜像到 PCB 背面、旋转一半电容器、使 VOUT 通过一个双电容器组、且电容器两侧接地。 将接地过孔放置在电容器封装下方、而不是放置在外部、以减少环路面积。
由于这是一个电感分压器、因此增加电感器通常会减小步进振幅、但所需的电感增加量是相当大的。 降低布局 ESL 通常是更有效的解决方案。