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[参考译文] TPS22997:当负载开关偏置(5V 开启)且 ON 置(负载开关启用)但输入(VIN)悬空时、输出端观察到漏电流

Guru**** 2502935 points
Other Parts Discussed in Thread: TPS22997

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1389992/tps22997-leakage-observed-on-output-when-load-switch-is-biased-5v-on-and-on-is-asserted-load-switch-enabled-but-input-vin-is-floating

器件型号:TPS22997

工具与软件:

您好!

我叫 Pritam、 Google 半导体团队的一名成员。  

我将 TPS22997负载开关用于其中一种评估板设计、主要用于创建上电序列。

但我观察到、当负载开关偏置(提供了 VBIAS = 5V)且负载开关启用(ON 引脚为高电平)时、但当 VIN (输入)悬空时、输出端会出现泄漏。

我向 BIAS 引脚提供5V VBIAS。 向负载开关提供 VBIAS 后、我将 ON 引脚置位(高电平)。 但是、输入引脚(VIN 引脚)悬空...因为在中、还没有向 VIN 引脚提供输入。

在该状态期间、我注意到输出引脚(VOUT)电平稳定增加、并不断增加、直到我提供 VIN (输入引脚不再悬空)或将 ON 引脚设置为低电平(或移除 VBIAS 5V)。

当 VIN 引脚悬空(VBIAS = 5V 且 ON 引脚为高电平)时、负载开关是否预期会出现此行为? 数据库不能真正指定这种特定情况下的行为。 我知道这可能不是 TPS22997的预期操作。 但是、我想了解是否会出现这种观察结果。

如果是、该泄漏来自哪里? 当 VIN 悬空(但 VBIAS = 5V 且 ON 引脚为高电平)时、该漏电流是否来自 VBIAS? 谢谢。

供参考:我已在负载开关上连接了一个小片段。  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Pritam:

    是的、这是预期的观察结果。

    由于 VBIAS=5V 且 ON 引脚为高电平、因此 FET 处于欧姆区域。 因此、VIN 的微小变化会导致漏极电流流动并为输出电容器充电。

    您能否将 VIN 和 ON 引脚放在一起。 因此、只要输入仅变为高电平、FET 就会导通?

    通过快照、我可以看到您的 VIN 为0.75V。 因此、您可以使用电阻分压器将 ON 引脚低电压范围用作。

    谢谢  

    Amrit  

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    谢谢 Amrit。 在探测负载开关的输出(例如之前分享的代码片段中的 VCORE_EXT)时、输出电容网络将从输出中移除。 因此、移除了输入旁路电容器。 因此、没有连接到充电器的输出电容器。 您是否认为泄漏电流给寄生电容(电源平面电容)充电?

    此外、您还提到导通 FET 位于欧姆区域(这会使导通 FET 对微小的变化非常敏感)、VIN 的微小变化(VIN 是连接到它的 floating...no 源极)会导致漏极电流流动。 由于(如数据表方框图所示)漏极连接到 VIN 且 VIN 悬空、漏极电流来自何处? 是否还有其他地方的电流可能从(例如来自 VBIAS)流入 NMOS 源(或 VOUT)?

    我们无法将输入连接到 ON 引脚、因为它用于非常特定的上电序列。 我们使用这些负载开关并通过控制 ON 引脚来对芯片的电源进行门控。  

    谢谢!

    Pritam S.  

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    您好 Pritam:

    感谢您清除系统条件。

    当 ON 引脚为低电平时- VOUT 通过快速输出放电电路通过电阻连接到 GND。 VOUT 引脚通过 IC 接地。

    当 ON 引脚为高电平时- 快速输出放电电路被禁用

    您在输出引脚上看到的可能是 Cgs、它由栅极电荷泵通过输出电阻器充电。

    您看到的输出电压是多少? 您能否使用不同的 R 值(10千欧、100千欧等)进行检查、如下图所示!

    谢谢你

    Amrit