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[参考译文] TPS54A24:原理图审阅

Guru**** 2412090 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1398849/tps54a24-schematic-review

器件型号:TPS54A24

工具与软件:

我们在  设计中使用器件 TPS54A24RTWR 向 Eths Switch IC 生成内核电压、 我会尝试运行 Webench、但结果不真实  

内核电压应该非常精确(典型值=0.8V、最小值=0.77V、最大值=0.83V)。

此外、我的板非常密集、因此我不想放置不必要的 BOM。

我的硬件团队中的方法是尽可能增加电容、但目前、如果没有必要、我无法添加电容。

VIN = 15V (忽略6V)

VOUT=0.8V

Iout=6A 时

如果它是过度设计让我知道,此外,我不想接近利润,所以请考虑它。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Dvir:

    我已经查看了您的原理图并进行了如下评论:

    - fsw:根据器件的 Ton 最小(max)以及 RRT (fsw)、Vout 和 Vin (基于您的原理图)、看起来器件可能达到最短导通时间、因此在轻负载条件下跳过脉冲。 理想情况下、(max) 30kHz=330kHz。 当前 Fsw=972kHz、这个值太高了。

    -电感器:电感器对于这个设计是高的,你需要低于0.78uH 的东西。 不过、如果您降低 Fsw=330kHz、则可以保持 L=1uH。 电感器错误会导致抖动增加和瞬态不良。  

    - PGOOD :我没有看到原理图中的上拉电阻器。 如果使用-100 kΩ 引脚、我们建议在10 kΩ PGOOD 与6.5V 或更低的电压源之间连接一个上拉电阻器、因为这是开漏输出引脚。

    "看来是我的女人了。

    - COMP:如果 Fsw 降低到330kHz,根据计算, 最好将 Rcomp 降低到5 kΩ  而不是10 kΩ  以获得稳定的波特。

    此致、  

    Eileen