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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1413162/tps54618-overvoltage-on-vo
工具与软件：
您好！
请参阅图中。
当 EN 关断时、 Vo 上可能会发生过压。
如果在 Vin 降至 UVLO 以下时 EN 关闭、似乎更有可能发生这种情况。
近况如何？
您能分享一下原理图吗？ 是否在 EN 引脚上使用分压器？ 如何连接 EN？
CH1是 Vin 吗？ 是否可以使用示波器测量电感器电流？
似乎 Vout 已经增加到高于目标电压(1.15V？) 大约-10usec 的时间。 这一点和高正 PH 引脚振铃表明 IC 正在灌入电流-电流正在从输出端移动到输入端。 当此反向电流达到其 反向电流限制阈值(D/S 中的第7.3.13节)时、VOUT 将上升。 输出端必须连接有某物、将电流倾入 Vout 上。
Chris
请参阅关联的 PDF。 输入/输出条件如下：
情况：关闭系统电源 输入电压：5V 输出电压：1.15V EN：其他 DC/DC 的电源正常引脚和5V 上拉电阻 受电器件：MCU (过压发生前复位完成)
e2e.ti.com/.../TPS54618.pdf
谢谢你。
感谢其他波形。
EN 引脚上是否有额外的上拉电阻器、或者只是开漏 PG 引脚？ EN 引脚上的电阻值在 Vin 达到 UVLO 电平之前不会使器件导通。
您能否确认 R9230是100k、R9231是220k、C9242是22pF？ 这些是该器件的相当大的电阻器。 噪声可能耦合到 VSENSE 引脚中、这会导致 Vout 最初上升。 您还能共享 PCB 布局吗？
谢谢！
感谢您的建议。
抱歉、框架外有100k 上拉电阻器。 --> Total 200kΩ
我尝试更换 FB 电阻器、但没有效果。
R9230 = 10k、R9231 = 22k
在以下情况下、软件似乎出现故障。 请调查。
当 Vin 为低电压时(在 UVLO 附近)、EN 变为低电平。
并附加了 PCB 布局。
谢谢 you.e2e.ti.com/.../TPS54618-layout.pdf
感谢您的分享。
您是说还有一个100k 上拉至5V 的电压？ 如果是、则形成等效的50k 上拉电阻。
您可以尝试将 R9233更改为39.2k 吗？ 这应该会将 VSTOP 电压提升至约2.5Vin、因此在触发 UVLO 之前 EN 将处于低电平。
在布局上、电感器和输出电容器非常远离 IC。 输出电容 GND 应靠近 IC PGND 和 Cin GND、以使开关电流环路保持紧密。 我看到的从输出电容器 GND 返回到 IC PGND 的路径会穿过所有小信号元件、例如 FB、SS、RT 和 COMP。 这可能会引入会干扰 IC 的 GND 偏移。 为了测试是否是这种情况、您可以屏蔽(将元件垂直放置、仅连接在1个焊盘上)。 将 GND 引线侧提起至空气中) C9235、R9237、C9234和 R9231。 然后、将这4个提升的 GND 焊盘连同一根小导线连接在一起、并将其重新连接到 IC 的 AGND 引脚。 查看关闭行为是否发生变化。
