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[参考译文] LM5045:最大 D 时的输出时序

Guru**** 1810440 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1426676/lm5045-output-timing-at-max-d

器件型号:LM5045

工具与软件:

 对于最大占空比工作条件、我不确定我 是否了解输出相对于 CLK 的时序 以及彼此的时序。  我在下面展示的内容是否正确?

 

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    您好!

    T1基于 RD1、T2基于 RD2。 您的数字混音、但不正确-请阅读数据表中的下表、以获取帮助。  

     

      

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    我知道 RD1和 RD2的作用。 我的图表与此没有冲突;您可能误解了我将 RD1和 RD2标记为什么。

    我想说的一点是、我要问的问题是、 在 dmax 下运行时、HO/LO 如何/何时会抵消? 我正在展示 它们在 CLK 上升沿终止-数据表中并未真正定义该上升沿。 我是对吗? 在这方面、我的图表是否正确?

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    您好!

    无论占空比是多少、T1始终针对这些初级侧驱动器的上升沿、T2始终针对下降沿。 此外、HO1和 LO2与 SR2配对、LO1与 SR1配对。 这些是清楚的,所以我只看的事情是你没有遵循这些,然后困惑自己。