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[参考译文] PROCESSOR-SDK-J784S4：wiz 文档和方框图

admin
Guru**** 2465890 points
Other Parts Discussed in Thread: TDA4VM

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1473305/processor-sdk-j784s4-wiz-documentation-and-block-diagrams

器件型号：PROCESSOR-SDK-J784S4
主题中讨论的其他器件：TDA4VM

工具与软件：

您好！

 

我正在尝试在串行器/解串器通道上设置环回。

 检查 SDK 后 、我发现 CSL_serdesSetLoopback 中使用的唯一环回类型是"line"和"ser"。 此函数用于配置 wiz 寄存器。

 

在 J784_Registers_20240628.xlsx 文件的选项卡247中、 我标识了多个与环回相关的寄存器、建议可以使用多种配置。 但是、这些环回类型之间的差异并不完全清楚。

 

是否有任何文档对串行器/解串器中的 wiz 模块进行了更详细的说明？ 理想情况下、说明输入和输出的方框图将非常有用。

 

谢谢你

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    TI__Guru**** 2465890 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Abdelhakim：

    [报价 userid="601413" url="~/support/processors-group/processors/f/processors-forum/1473305/processor-sdk-j784s4-wiz-documentation-and-block-diagrams 是否有任何文档对串行器/解串器中的 wiz 模块提供了更详细的解释？ 在理想情况下、说明输入和输出的方框图将非常有用。

    wiz 模块是 SerDes IP。

    请浏览一章 12.2.5串行器/解串器(SerDes) 具体功能。

    此致

    Suman

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    TI__Guru**** 2465890 points
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    尊敬的 Suman：

    我们已经确定了 TRM 中提到串行器/解串器可配置为环回模式的一节："对于线路侧和并行侧、均可配置串行位流和并行字环回"。

    您能否确认使用 CSL_SERDES_LOOPBASE_SER 启用环回、并模拟 TX 差分对与 RX 的连接？ 此外、我们要验证 CSL_SERDES_LOOPBASE_LINE 的行为就像输入和输出连接到外设侧一样。

    此致、
    Romain

  • 0
    TI__Guru**** 2465890 points
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    尊敬的 Romain：

    请在单独的主题中提出与最新串行器/解串器功能行为相关的问题、因为主题标题中的原始主题已得到解答。

    此致

    Suman

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    TI__Guru**** 2465890 points
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    谢谢你。

    我在 TRM 中的其他地方找到了一些有关 wiz 配置的信息。

    但是、我找不到上述部分"10G 串行器/解串器编程指南"。

    您能说明一下它在哪里吗？

    此致、

  • 0
    TI__Guru**** 2465890 points
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    尊敬的 Abdelhakim：

    部分未在使用此 wiz IP 块开发 J721E/TDA4VM 时重新添加串行器/解串器编程指南。 我们在 J784S4中重复使用了 J721E 中的 IP 块、因此很可能也复制了 TRM 中的各节。 因此、很遗憾、我们没有10G 串行器/解串器编程指南。

    在任何情况下、该环回功能都用于测试和诊断串行器/解串器块。 串行器/解串器用于 PCIe、以太网、USB 或显示屏背景、因此客户无需仅测试串行器/解串器块。 因此、这一特性通常没有用处。

    这里的用例是什么？

    此致、

    Takuma