[参考译文] AM62A7-Q1：MDC 频率配置不生效且 MDIO 时序不正确。

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https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1475054/am62a7-q1-mdc-frequency-configuration-does-not-take-effect-and-mdio-timing-is-incorrect

器件型号：AM62A7-Q1

工具与软件：

您好！

我试图修改 MDC 的速率,但它没有生效。我的器件树配置如下：

		cpsw3g_mdio: mdio@f00 {
			compatible = "ti,cpsw-mdio","ti,davinci_mdio";
			reg = <0x0 0xf00 0x0 0x100>;
			#address-cells = <1>;
			#size-cells = <0>;
			clocks = <&k3_clks 13 0>;
			clock-names = "fck";
			bus_freq = <2500000>; 
		};

我使用示波器获得的实际信号如下：

测得的实际速度为556K、MDC 和 MDIO 之间存在延迟。

我有以下问题：

1.为什么设备树配置不起作用?

2.为什么 MDC 和 MDIO 之间存在延迟? 理论上、这两个信号之间不应有延迟。

谢谢！

Yuwei

8 个月前

0 admin 8 个月前

TI__Guru**** 2465890 points

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谢谢！

0 admin 8 个月前

TI__Guru**** 2465890 points

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您好、Yuwei、

1.您使用的是哪个 Linux SDK 版本？

2.您使用的是 TI EVM 还是定制的电路板？

Unknown 说：
我试图修改 MDC 的速率、但它没有生效。

Unknown 说：
1.为什么设备树配置不起作用？

3.请问,是否有具体的原因改变 MDC 的速率?

Unknown 说：
2.为什么 MDC 和 MDIO 之间存在延迟？理论上、这两个信号之间不应有延迟。

4.澄清一下,您是否在没有对设备树配置进行任何更改的情况下看到了此延迟(即没有您为尝试修改 MDC 速率而进行的更改)?

5.请问、在 MDC 和 MDIO 之间出现延迟时、与以太网 PHY 的 MDIO 通信出现了问题吗？根据我的理解、理论上应该有一定的延迟、这样 MDIO 信号可以在 MDC 的上升(或下降)边沿上进行采样。您能多解释一下为什么您在理论上认为两个信号之间不应有延迟吗？

-道林

0 admin 8 个月前

TI__Guru**** 2465890 points

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最新动态：

Unknown 说：
5. 我想问一下、由于 MDC 和 MDIO 之间存在此延迟、与以太网 PHY 进行 MDIO 通信时出现了问题吗？根据我的理解、理论上应该有一些延迟、这样 MDIO 信号可以在 MDC 的上升(或下降)边沿进行采样。您能多解释一下为什么理论上两个信号之间不应有延迟？

为了澄清、我无法肯定 MDC 和 MDIO 之间是否存在延迟、这就是为什么我要问您是否观察到当前延迟的问题。

此外、您可以共享整个启动日志吗？目标是检查 MDIO 是否在器件上配置为手动/位旁模式(类似于下面我在 AM62x SKEVM 上所做的配置)。如果 MDIO 处于手动模式、这可能是更改 MDC 速率未生效的原因(对于 MDC 和 MDIO 均为手动模式)。

root@am62xx-evm:~# dmesg | grep manual
[   1.999276] davinci_mdio 8000f00.mdio: Configuring MDIO in manual mode
root@am62xx-evm:~#

-道林

处理器（参考译文帖）

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[参考译文] AM62A7-Q1：MDC 频率配置不生效且 MDIO 时序不正确。