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[参考译文] AM620-Q1:在 AM62切换为–quot;deep sleep mode"或–quot;partial I/O mode"后、我们能否保持 GPIO 状态?

Guru**** 2455360 points
Other Parts Discussed in Thread: SK-AM62-LP

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https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1451953/am620-q1-could-we-keep-gpio-status-after-am62-swap-into-deep-sleep-mode-or-partial-i-o-mode

器件型号:AM620-Q1
Thread 中讨论的其他器件:SK-AM62-LP

工具与软件:

您好、亲爱的专家

如标题说明、客户希望在 SoC 切换为 "深度睡眠"或"部分 I/O "模式后保持"最后一个 I/O 状态"。

例如、GPIO0_49 =低电平处于"正常工作模式"、然后我们希望  GPIO0_49"保持低电平" (当 SoC 切换为"深度睡眠"或"部分 I/O"模式时)。

有可能吗?

或者、我们是否可以在 SOC (AM62)交换到"深度睡眠"或"部分 I/O "模式时设置每个 GPIO 状态?

非常感谢

Gibbs

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    您好、Gibbs、

    客户计划使用什么操作系统? 这将帮助我们确定合适的专家来支持这一调查。

    -道林

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    我们发现、当 GPIO 没有上拉或下拉电阻时、当它进入深度睡眠模式时、GPIO 可以保持为上拉(1.8V)或下拉(0V)、但当有上拉电阻时、将 GPIO 设置为下拉输出、而 GPIO 在工作模式下的输出为1.8V、进入深度睡眠模式后、GPIO 的电压变为1.2V、有上拉电阻时、将 GPIO 设置为下拉输出 且正常模式为0V、深度转换模式下的 GPIO 电压变为1.2V、进入深度睡眠模式后 GPIO 输出是否会变弱?

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    您好!

    为清楚起见、GPIO 无法更改 性能 深度睡眠或部分 I/O 暂停序列中的步骤之一是保存 IO 上下文、然后在唤醒序列期间恢复该上下文。 这意味着必须在进入 SUSPEND 状态之前设置一个 GPIO、然后在 SUSPEND 序列期间保持。


    通过先前的实验进入睡眠模式时、GPIO 电压往往会发生轻微变化(活动时为3.3V、深度睡眠时为3.28V)。 可以利用内部拉电阻器来保持现有状态。 请参阅 AM62x TRM: https://www.ti.com/lit/ug/spruiv7b/spruiv7b.pdf 中的14.2.1.2焊盘配置寄存器

    您可以使用 devmem2写入寄存器、以测试暂停状态下内部拉电阻器的切换情况。 您还可以查看 FORCE_DS_EN、以了解进入暂停状态时应使用哪种 IO 状态。

    此致、

    Anshu

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    在进入深度睡眠模式之前、我曾尝试将 GPIO 设置为 DevMEM2 0x000F40C4 W 0x00018007/0x01018007、并下拉 GPIO 输出、进入深度睡眠之前的 GPIO 电压为0V、但进入深度睡眠后、由于存在外部1.8V 上拉电阻、GPIO 电压再次变为1.2V、似乎没有任何影响、请查看是否有其他解决方案

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    您好、Anshu

    需要更新。 如果我说错了、请纠正。

    谢谢!

    以下是我的评论。

    你好、 

    我想您也可以检查"FORCE_DS_EN"位、而不仅仅是"DS_EN"位。

    DevMEM2 0x000F40C4 W 0x00018007/0x01018007  

    参考 TRM p5818。

    例如,我想(猜测),

    FORCE_DS_EN = 1

    DS_EN = 0

    DSOUT_VAL = 0 (如果需要设置为0)

    DS_PULLUD_EN = 0

    DS_PULLTYPE_SEL = 0

    顺便说一句,我找到了一个好的提示,为你学习

    参考

    https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1078518/dra821u-j7200?ReplyFilter=Answers&ReplySortBy=Answers&ReplySortOrder=Descending

    https://www.ti.com/lit/ug/spruiu1d/spruiu1d.pdf?ts = 1736745878006&ref_url=https%253A%252F%252Fwww.ti.com%252Fproduct%252FDRA821U%253FkeyMatch%253Ddra8%2526tisearch%253Duniversal_search%2526usecase%253Dpartmatches

    --> p681、 CTRLMMR_WKUP_PADCONFIG54

    此调试体验应该与 AM62x 非常相似

    请像该主题一样记录您的测试步骤。

    谢谢

    Gibbs

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    嗨、Gibbs、

    因为我是度假回来的,所以很抱歉耽误了时间。 我见过其他人询问如何保持 GPIO 拉至高电平、但不是低电平。 我正在努力复制此问题、因此请留出一些时间继续对此进行调试、并预计在本周星期五之前进行更新。

    谢谢!

    Anshu

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    嗨、Gibbs、

    下面是我所做的:

    • 硬件:SK-AM62-LP
    • 软件:Linux SDK 10.0

    在 Linux 器件树中、我分配了两个 GPIO:

    &main_pmx0 {
        main_gpio0_pins_default: main-gpio0-default-pins {
    		pinctrl-single,pins = <
    		    AM62X_IOPAD(0x009c, PIN_INPUT, 7) /* (V25) GPMC0_WAIT1.GPIO0_38 */
    		    AM62X_IOPAD(0x00ac, PIN_INPUT, 7) /* (L21) GPMC0_CSn1.GPIO0_42 */
    		>;
    	};
    };
    
    &main_gpio0 {
    	status = "okay";
    	pinctrl-names = "default";
    	pinctrl-0 = <&main_gpio0_pins_default>;
    	gpio-line-names = "", "", "", "", "", "", "", "", "", "", // main_gpio0_0 -> 9
    						"", "", "", "", "", "", "", "", "", "", // main_gpio0_10 -> 19
    						"", "", "", "", "", "", "", "", "", "", // main_gpio0_20 -> 29
    						"", "", "", "", "", "", "", "", "MG038", "", // main_gpio0_30 -> 39
    						"", "", "MG042", "", "", "", "", "", "", ""; // main_gpio0_40 -> 49
    };

    这两个 GPIO 都没有任何外部拉电阻器、如 SK-AM62-LP 原理图所示:

    在 EVM 的 Linux 命令行中、我将两个 GPIO 都设置为低电平:

    root@am62xx-lp-evm:~# gpioset MG038=0
    root@am62xx-lp-evm:~# gpioset MG042=0

    PADCONFIG 寄存器值如下:

    我更改了 GPIO 的一个 PADCONFIG 寄存器、通过更改 BIT16 (0x00050007 -> 0x000)来启用内部下拉电阻 4. 0007)。 没有其他更改。

    root@am62xx-lp-evm:~# cat /sys/kernel/debug/pinctrl/f4000.pinctrl-pinctrl-single/pingroups
    ...
    group: main-gpio0-default-pins
    pin 39 (PIN39)
    pin 43 (PIN43)
    ...
    
    root@am62xx-lp-evm:~# cat /sys/kernel/debug/pinctrl/f4000.pinctrl-pinctrl-single/pinmux-pins | grep main-gpio0
    pin 39 (PIN39): 600000.gpio (GPIO UNCLAIMED) function main-gpio0-default-pins group main-gpio0-default-pins
    pin 43 (PIN43): 600000.gpio (GPIO UNCLAIMED) function main-gpio0-default-pins group main-gpio0-default-pins
    
    root@am62xx-lp-evm:~# cat /sys/kernel/debug/pinctrl/f4000.pinctrl-pinctrl-single/pins | grep 'pin 39'
    pin 39 (PIN39) 38:600000.gpio f409c 00050007 pinctrl-single 
    root@am62xx-lp-evm:~# cat /sys/kernel/debug/pinctrl/f4000.pinctrl-pinctrl-single/pins | grep 'pin 43'
    pin 43 (PIN43) 42:600000.gpio f40ac 00040007 pinctrl-single 
    root@am62xx-lp-evm:~# 
    

    我在进入和退出深度睡眠之前测量了 GPIO 的电压。

    非常重要 而无需内部下拉电阻 中、唤醒时 GPIO 电压略有增加。 该峰值为136mV。

    添加了具有内部下拉电阻器的 GPIO 、从深度睡眠中唤醒时 GPIO 电压没有变化。

    如果通过更改 PADCONFIG 寄存器的位16启用内部下拉电阻器、则假定引脚上没有上拉电阻器、电压应该没有变化。

    此致、

    Anshu

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    您好、 Anshu

    非常感谢您提供详细的测试结果

    让我们学习。

    Gibbs

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    你好、 Gibbs

       我按您所说的尝试了 DevMEM2 0x000F40C4 W 0x00018007/0x01018007、然后将 GPIO 设置为低电平、进入深度睡眠模式、因为外部有一个1.8V 的上拉电阻器、所以它仍然能够输出1.2V、这种现象没有改变

           

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    你好、 

    (1)建议您"首先"复制 ANSHU 对 EVB (SK-AM62-LP)的测试、因为我们需要确保您具有正确的软件设置概念

    (2)然后、将原理图中的"GPIO0_49"器件发布、该器件可能包含相关 PU/GPIO/或连接到此 PD 的相关器件。  

    (3)顺便说一下、请转储"GPIO0_49"的引脚多路复用设置。 (devmem2 0x000F40C4)

    (4)如果可能、尝试在不连接 PU/CPU PD 电阻器的情况下断开另一个器件的连接、直接测量引脚排列。

    (5)顺便说一下、根据 Anshu 的测试、我发现值应该是0x0005007或0x0004007

    Gibbs

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    你好、Gibbs

       我是电路图中的 GPIO0_49

    如果我们移除外部的上拉电阻、GPIO 可以在深度睡眠模式下拉至低电平、但在外部使用上拉电阻时、只能将电压更改为1.2V

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    你好、 

    如何使用 0x0005007或0x0004007?

    Gibbs

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    仍然没有

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    尊敬的 xiao-an:

    如果您在 TI EVM 上复制此内容、请告知我们。 GPIO 将受外部上拉/下拉电阻器的影响。

    此致!

    Anshu

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    Anshu、您好:

         我测试了 SCL 引脚(如图所示)、并将其修改为 GPIO 引脚模式 devmem2 0x000F40B0 w 0x00010007/0x01018007/0x00040007/0x0005007、然后将其设置为低电压、在进入睡眠模式之前测量的电压 R30 (两端电压均为3.3V)以及进入深度睡眠后的电压 R30 (两端电压均为3.3V 和2.7V)。

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    尊敬的 xiao-an:

    请告诉我我对这个问题的理解是否正确。

    当 SoC 处于深度睡眠状态和部分 I/O 时、您要尝试保持 GPIO 电压较低(~0V)、但有一个外部上拉电阻连接到 GPIO。

    确认后、我们可以继续调试该问题。

    谢谢!

    Anshu

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    你(们)好  

    您的理解是正确的

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    尊敬的 xiao-an:

    感谢您的确认。

    一个问题是、外部上拉电阻器可能会导致 GPIO 值略有变化、因为我不认为内部下拉电阻器会足够强来保持电压下降、电压会发生冲突。

    说明如何将 GPIO 设置为低电平。 这是通过用户空间还是通过其他方式? 共享与 GPIO 相关的任何器件树更改。

    此致、

    Anshu

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    Anshu、您好:

       首先、将树对设置为使用 GPIO 配置、如下所示:AM62X_IOPAD (0x0d8、PIN_OUTPUT、7)、然后在应用程序层使用 gpioset -z -c gpiochip0 19=0、测量进入深度睡眠之前和之后的 GPIO 电压(寄存器地址和 GPIO 只是示例、并不表示 GPIO 的实际使用)。

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    尊敬的 Anshu:

        我们使用的版本是10.0.007、我看到版本10.01.10有一个解决 GPIO 无法保留的问题的办法、请看它与我们的这个问题相关。

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    尊敬的 xiao-an:

    驱动程序有一些改动、我们欢迎您为此尝试新的 SDK。

    谢谢!

    Anshu

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    尊敬的 Anshu:

        TI 可以提供一种相关的途径来解决此问题。

    谢谢。

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    嗨、 Anshu、 

      我们试图使用 TI 针对 EVB 版本的最新 SDK 进行测试、但问题仍未解决。

    在进入深度睡眠模式之前、设置 DevMEM2 0x000F40B0 W 0x00010007、然后使用 GPIOSET 将 GPIO0_43设置为低电平、然后进入深度睡眠模式、测量 R30段的电压至2.7V。看起来有外部上拉电阻器时、它在深度睡眠模式。μ s 下仍无法拉至低电平

    测量 PMIC_LPM_EN0引脚也不会指示 AM62X 是否已进入深度睡眠模式。

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    尊敬的 Xaio-An:

    我将在硬件团队中循环介绍原理图方面的内容。 请等待一段时间进行回复。

    谢谢!

    Anshu

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    尊敬的 Xaio-An:

    我不确定我需要回顾哪些内容、请您指出一下。

    此致、

    Sreenivasa

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    您好、Sreenivasa

    让我来总结一下我们的讨论、

    我们的目标:

    我们将 GPIO (例如:主域 GPIO0_43/42/38)输出设置为低电平、并希望 GPIO0_43在 AM62进入深度模式时"保持低电平"。  

    实验1.

    我们发现、 当 AM62处于深度睡眠时、GPIO0_43可以保持低电平、但它需要基于 GPIO0_43悬空的 W/O PU 电阻器

    实验2.

    我们发现、 当 AM62处于深度睡眠模式时、GPIO0_43无法保持低电平、因为 GPIO0_43具有外部 PU 电阻(4.7K/10k)至3.3V。 我们在深度睡眠模式下测量 GPIO0_43"返回"至2.7V。

    这里有一些问题、

    (1)根据我们的应用目标、GPIO0_43的正确引脚多路复用设置是什么?

    我们已经尝试了这些值、但没有效果

    --> 0x00010007/0x01018007/0x00040007/0x0005007

    (2)这是否意味着我们的"内部 PD 电阻不够强?

    (3)根据我们的应用目标、我们是否对使用 GPIO0_43的原理图设计有任何建议?

    我们希望 GPIO0_43始终在深度睡眠模式下保持低电平。

    谢谢你

    Gibbs

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    您好、Sreenivasa

    让我来总结一下我们的讨论、

    我们的目标:

    我们将 GPIO (例如:主域 GPIO0_43/42/38)输出设置为低电平、并希望 GPIO0_43在 AM62进入深度模式时"保持低电平"。  

    实验1.

    我们发现、 当 AM62处于深度睡眠时、GPIO0_43可以保持低电平、但它需要基于 GPIO0_43悬空的 W/O PU 电阻器

    实验2.

    我们发现、 当 AM62处于深度睡眠模式时、GPIO0_43无法保持低电平、因为 GPIO0_43具有外部 PU 电阻(4.7K/10k)至3.3V。 我们在深度睡眠模式下测量 GPIO0_43"返回"至2.7V。

    这里有一些问题、

    (1)根据我们的应用目标、GPIO0_43的正确引脚多路复用设置是什么?

    我们已经尝试了这些值、但没有效果

    --> 0x00010007/0x01018007/0x00040007/0x0005007

    (2)这是否意味着我们的"内部 PD 电阻不够强?

    (3)根据我们的应用目标、我们是否对使用 GPIO0_43的原理图设计有任何建议?

    我们希望 GPIO0_43始终在深度睡眠模式下保持低电平。

    谢谢你

    Gibbs

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    您好、Gibbs、  

    我需要在内部进行检查。

    我怀疑我们需要使用位27、Bot 28和 DNI 外部电阻器。 我会与团队确认。

    此致、

    Sreenivasa  

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    你好、吉布斯

    [报价 userid="533255" url="~/support/processors-group/processors/f/processors-forum/1451953/am620-q1-could-we-keep-gpio-status-after-am62-swap-into-deep-sleep-mode-or-partial-i-o-mode/5654308 #5654308"]

    实验2.

    我们发现、 当 AM62处于深度睡眠模式时、GPIO0_43无法保持低电平、因为 GPIO0_43具有外部 PU 电阻(4.7K/10k)至3.3V。 我们在深度睡眠模式下测量 GPIO0_43"返回"至2.7V。

    [报价]

    内部 PUL 值大约为50K 标称值。

    这表明启用了下拉和上拉

    RPU 上拉电阻器40 50 60 kΩ
    RPD 下拉电阻器40 50 60 kΩ

    您可能需要查看 PAD CONFIG 寄存器的第24..28位、以确保没有启用下拉并进行验证。

    此致、

    Sreenivasa

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    您好、 Sreenivasa 和 Anshu

    谢谢您的回复

    我有两个问题、

    [问题1]哪个是正确的 PD 内部 电阻器?

    我注意到 电阻器具有三个值(40/50/60/k kΩ Ω)、哪一个是正确的 PD 电阻器?

    [问题2]位24~28的正确位设置是什么?

    因为我会尝试确定这是硬件或软件问题、 因此、我需要先锁定软件设置。

    以下是 kΩ 在 GPIO0_38上针对 AM62_LP_EVM 使用 PU 电阻器(10/k Ω)进行的测试

    我需要您的建议、因为我想知道正确设置(PADCONFIG)是什么样的?

    我们是否应该同时增加(或减少)外部 PU 电阻器来解决此问题?

    PADCONFIG = 0x0001 0007
    我  在 DS 模式下测量 GPIO0_38 = 2.7V、即使我们在进入 DS 模式之前设置 GPIO0_38 = 0V 也是如此
    位28、DS_PULLTYPE_SEL = 0、已选择关闭模式下拉
    位27、DS_PULLUD_EN = 0、PU/FPU PD 被启用
    位26、DSOUT_VAL = 0、输出值= 0
    位25、DSOUT_DIS = 0、输出使能
    位24、DS_EN = 0、当深度睡眠模式激活时、I/O 保持先前的状态

    PADCONFIG =0x0201 0007
    我  在 DS 模式下测量 GPIO0_38 = 2.7V、即使我们 在进入 DS 模式之前设置 GPIO0_38 = 0V 也是如此
    位28、DS_PULLTYPE_SEL = 0、已选择关闭模式下拉
    位27、DS_PULLUD_EN = 0、PU/FPU PD 被启用
    位26、DSOUT_VAL = 0、输出值= 0
    位25、DSOUT_DIS = 1、输出禁用
    位24、DS_EN = 0、当深度睡眠模式激活时、I/O 保持先前的状态

    PADCONFIG =0x0004 0007
    我  在 DS 模式下测量 GPIO0_38 = 2.7V、即使我们 在进入 DS 模式之前设置 GPIO0_38 = 0V 也是如此
    位28、DS_PULLTYPE_SEL = 0、已选择关闭模式下拉
    位27、DS_PULLUD_EN = 0、PU/FPU PD 被启用
    位26、DSOUT_VAL = 0、输出值= 0
    位25、DSOUT_DIS = 0、输出使能
    位24、DS_EN = 0、当深度睡眠模式激活时、I/O 保持先前的状态
    位18、RXACTIVE、ENABLE

    PADCONFIG =0x0001 0087
    我  在 DS 模式下测量 GPIO0_38 = 2.7V、即使我们 在进入 DS 模式之前设置 GPIO0_38 = 0V 也是如此
    位28、DS_PULLTYPE_SEL = 0、已选择关闭模式下拉
    位27、DS_PULLUD_EN = 0、PU/FPU PD 被启用
    位26、DSOUT_VAL = 0、输出值= 0
    位25、DSOUT_DIS = 0、输出使能
    位24、DS_EN = 0、当深度睡眠模式激活时、I/O 保持先前的状态
    位15、FORCE_DS_EN = 1、负深度睡眠焊盘控制、覆盖 DMSC0

     

    非常感谢

    Gibbs

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    你好、吉布斯

    谢谢你。

    [报价 userid="533255" url="~/support/processors-group/processors/f/processors-forum/1451953/am620-q1-could-we-keep-gpio-status-after-am62-swap-into-deep-sleep-mode-or-partial-i-o-mode/5659495 #5659495"]

    [问题1]哪个是正确的 PD 内部 电阻器?

    我注意到 电阻器具有三个值(40/50/60/k kΩ Ω)、哪一个是正确的 PD 电阻器?

    [报价]

    请参阅数据表。

    内部拉电阻有宽范围。

    此致、

    Sreenivasa

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    更新了、

    基于 LVCMOS、不同的 VDD_IO 电压具有不同的 PU/LVCMOS PD 电阻值

    Gibbs

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    您好、Gibbs、  

    谢谢你。  

    [报价 userid="533255" url="~/support/processors-group/processors/f/processors-forum/1451953/am620-q1-could-we-keep-gpio-status-after-am62-swap-into-deep-sleep-mode-or-partial-i-o-mode/5662952 #5662952"]基于 LVCMOS、不同的 VDD_IO PD 电压具有不同的 PU/LVCMOS 电阻值[/QUOT]

    请参阅以下内容。 不确定上述表述的含义。

    7.8.6 LVCMOS 电气特性

    1.8V 模式

    RPU 上拉电阻器15 22 30 kΩ
    RPD 下拉电阻器15 22 30 kΩ

    3.3V 模式

    RPU 上拉电阻器15 22 30 kΩ
    RPD 下拉电阻器15 22 30 kΩ

    此致、

    Sreenivasa

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    嗨、Gibbs、

    更改位24:28只有在位15 = 1时才有意义。

    此致、

    Anshu

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    您好、Anshu

    让我来检查一些东西。

    (1)我们只需要"关心" 位24:28并让 位15 = 1、不是吗?

    (2)我们是否应该让这个引脚成为"输入"? 因为我听说过一些信息、PD 只有内部 PU/GPIO"输入模式"下才有活动、不是吗?

    所以、我想正确的设置可能会   PADCONFIG = x x x 000000048007

    第28位、DS 下拉使能

    位27、DS_PULLUD_EN = 0、PU/LVDS 在 DS 模式下启用 PD
    位26、DSOUT_VAL = 0、输出值= 0
    位25、DSOUT_DIS = 0、输出使能
    位24、DS_EN = 0、当深度睡眠模式激活时、I/O 保持先前的状态
    位15、FORCE_DS_EN = 1、负深度睡眠焊盘控制、覆盖 DMSC0

    位18 =1、输入模式(RX)

    ~、我们还需要关注大约15m Ω 30kΩ 的内部 PD 电阻器、因此、如果客户希望状态在 DS 模式下保持低电平、则可能需要增加"外部"PU 电阻器。

    谢谢

    Gibbs

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    嗨、Gibbs、

    第18位启用/禁用焊盘的输入缓冲器。 这意味着将该位设置为高电平将允许焊盘能够接收数据。

    [报价 userid="533255" url="~/support/processors-group/processors/f/processors-forum/1451953/am620-q1-could-we-keep-gpio-status-after-am62-swap-into-deep-sleep-mode-or-partial-i-o-mode/5678335 #5678335"]但我们还需要关注约15~30kΩ 的内部 PD 电阻、因此如果客户希望状态在 DS 模式下保持低电平、则可能需要增加"外部"PU 电阻。

    我将在硬件团队中针对该问题循环发言。

    此致、

    Anshu

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    大家好!

    我知道是否要在 DEEPSLEEP 中保持已知状态、内部拉动应支持、并且可能不需要外部极。  

    此致、

    Sreenivasa

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    关闭该主题

    客户添加 PU 100k 电阻以解决此问题。

    Gibbs

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    你好、 吉布斯

    感谢您的参与。

    此致、

    Sreenivasa

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    你好、 吉布斯

    [报价 userid="533255" url="~/support/processors-group/processors/f/processors-forum/1451953/am620-q1-could-we-keep-gpio-status-after-am62-swap-into-deep-sleep-mode-or-partial-i-o-mode/5713882 #5713882"]客户添加 pu 100k 电阻器解决此问题。[/QUOT]

    鉴于 LVCMOS IO 漏电流、100K 上拉可能是一个问题。

    请参阅常见问题解答的以下部分:

    有关为 LVCMOS IO 选择上拉电阻(上拉电阻或下拉电阻)的额外输入

    https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1386586/faq-am62x-am64x-am243x-custom-board-hardware-design-how-to-handle-used-unused-pins-peripherals-e-g-gpios-serdes-usb-csi-mmc-emmc-sd-card-csi-oldi-dsi-cap_vddsx

    此致、

    Sreenivasa