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[参考译文] DRA829J:主域中 R5F 子系统的功能时钟

Guru**** 2330840 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1519484/dra829j-functional-clock-for-r5f-subsystems-from-main-domain

器件型号:DRA829J

工具/软件:

尊敬的 TI-Team、

在检查 TRM 的 R5FSS0和 R5FSS1功能时钟源时、我们意识到在集成图中、有一个 CTRL_MMR0寄存器用于选择时钟源。
但是、使用相应的选项检查表时、只有一个值。 此外、我们没有找到任何用于为 R5FSS0和 R5FSS1选择时钟源的寄存器。
图表错误或表需要更新。 请参阅以下图片:

您能否检查并确认哪一项信息正确?

提前感谢您。

此致、
António μ s

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Antonio:

    Unknown 说:
    图表错误或表需要更新。 查看以下图片:

    我可以确认该图错误(看起来是复制粘贴内容并从 MCU R5FSS 进行修改)。 MCU R5FSS 确实有一个用于选择333 MHz 功能时钟的有效 CTRL_MMR 寄存器(建议仍在1000 MHz 上运行它)、但 主 R5FSS0和主 R5FSS1实例没有这样的选择逻辑。 它们确实应该在1000 MHz 下运行、接口时钟在250 MHz 时钟上运行。

    MAIN_PLL14_HSDIV0_CLKOUT 的四分频确实为 ICLK 供电、也用于该 MAIN_PLL14 HSDIV 时钟的 DCC 监控。

    此致

    Suman

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    感谢 Suman 的确认。
    现在我们已经很清楚了。