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[参考译文] DRA821U:使用单个 TPS6594-Q1 PMIC (PDN-2A) 为 JacintoTM 7 J7200 DRA821 供电的用户指南

Guru**** 2425250 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1524156/dra821u-user-guide-for-powering-jacintotm-7-j7200-dra821-with-single-tps6594-q1-pmic-pdn-2a

器件型号:DRA821U
主题:DRA821 中讨论的其他器件

工具/软件:

您好:

我将 使用 DRA821 处理器并使用文档  “slvucd4.pdf"实现“实现单 PMIC 电源方案。

我的问题是 GPIO6 的上拉电源轨。  

本文档将该信号称为 EN_DDR_RET_1V1、并建议上拉电源轨为 VDD_DDR_1V1_REG。

这用于使 LDO 能够提供电源轨 VDD1_LPDDR4_1V8。

这意味着 DDR 1V1 电源轨将先于 DDR 1V8 电源轨。

我认为这是一个错误。

LPDDR4 需要在 1V1 电源轨之前为 1V8 电源轨供电。

注意:我不打算在设计中使用 DDR 保持模式。

Q1/是否可以 使用电源轨 VDD_IO_1V8 (PMIC LDO1) 启用 DDR 1V8 LDO?

Q2/是否可以将电源轨  VDD_IO_1V8 (PMIC LDO1) 直接连接至 DDR4 1V8 引脚?

Q3/如何将 CPU 引脚 DDR_RET(焊球编号 R5)接通?

谢谢、

Steve

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    0、DRA821 PDN-2A 方案使用分立式或门、以便允许 EN_DDR_RET_1V1 控制、从而在 DDR 保持低功耗模式期间使 VDD1_DDR_1V8 电源保持通电。 VDD_IO_1V8 电源是或门的第二个输入、并负责上电和断电时序控制。

    1.和 2. 是的、如果您未使用 DDR 保持功能、则可以单独使用 VDD_IO_1V8 来控制 VDD1_DDR_1V8 LDO。

    3.如果不打算使用 DDR 保持电路、则安装一个连接到 R5 (DDR_RET) 的 10k 下拉电阻。  

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    您好 Bill
    您上面提到的参考原理图是否可用于下载 DRA821 和 PDN-2A?
    谢谢、此致
    Stephan