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[参考译文] AM62A7-Q1:如何在 Nanya DRAM 中进行 RD(读取)DQ 校准?

Guru**** 2422710 points
Other Parts Discussed in Thread: AM62A7-Q1, AM62A7

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1537781/am62a7-q1-how-to-rd-read-dq-calibration-in-nanya-dram

器件型号:AM62A7-Q1
主题: AM62A7 中讨论的其他器件

工具/软件:

您好、专家
环境:
  SOC:AM62A7-Q1
  DRAM:Nanya NT6AN256T32AC-J1H
问题:
  为确保功能安全、我们需要检查 DRAM 引脚 (DQ) 的连接。 以下是 Nanya 数据表中 DQ 的步骤:
我们在 AM62A7 TRM 中没有找到相关的寄存器。 如何进行 RD(读取)DQ 校准?
此致、
Xue Fadong
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Xue:

    有一些寄存器允许用户读取/写入存储器中的 MR 寄存器。  以下是一些可轻松适应 C 代码的示例 GEL 函数。  仅当正确初始化和训练 DDR 控制器/PHY 时、这些函数才起作用。

    wait()

    unsigned int i;
    for (I=0;I<10000;I++);
    }

    check_and_Ack_mrw()

    while ((HW_RD_REG32 (CTL_BASE + DDRSS_CTL_351__SFR_OFFS)& 0x8)= 0x0)
    wait();
    HW_WR_REG32 (CTL_BASE + DDRSS_CTL_359__SFR_OFFS、0x8);//确认状态模式位
    wait();
    }

    check_and_Ack_Mr()

    while ((HW_RD_REG32 (CTL_BASE + DDRSS_CTL_351__SFR_OFFS)& 0x4)= 0x0)
    wait();
    HW_WR_REG32 (CTL_BASE + DDRSS_CTL_359__SFR_OFFS、0x4);//ack STATUS 模式位
    wait();
    }

    hotmenu mr_Write(unsigned int mr_addr、unsigned int cs、unsigned int 数据)

    HW_WR_REG32 (CTL_BASE + DDRSS_CTL_190___SFR_OFFS、((1UL << 23)|(Cs << 8)| MR_addr);
    wait();
    HW_WR_REG32 (CTL_BASE + DDRSS_CTL_225__SFR_OFFS、DATA);
    //触发器写入
    wait();
    HW_WR_REG32 (CTL_BASE + DDRSS_CTL_190___SFR_OFFS、((1UL << 25)|(1UL << 23)|(CS << 8)| MR_addr);//设置位 25 以进行写入
    wait();
    check_and_Ack_mrw();
    GEL_TextOut(“将%x 写入 mr%d\n“、、、、、 DATA、mr_addr);

    }

    hotmenu mr_read (unsigned int mr_addr、unsigned int cs)

    HW_WR_REG32 (CTL_BASE + DDRSS_CTL_190___SFR_OFFS、((cs << 8)| MR_addr)<< 8);//CS0 MR0
    HW_WR_REG32 (CTL_BASE + DDRSS_CTL_190__SFR_DIONS)((1UL<<16)|(CS << 8)| MR_addr)<< 8);//触发器读取
    check_and_Ack_MRR ();
    return (HW_RD_REG32 (CTL_BASE + DDRSS_CTL_192__SFR_OFFS));

    }


    此致、

    James