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[参考译文] AM62P:DRVVBUS 端子输出电平降低的原因

Guru**** 2802435 points

Other Parts Discussed in Thread: AM62P, SN74LV1T08

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1620407/am62p-causes-of-the-decrease-in-drvvbus-terminal-output-level

部件号: AM62P
主题中讨论的其他器件: SN74LV1T08

您好的团队、
目前、在评估配备 AM62P 的定制板时、我们正在评估 USB 接口。

如下图所示、定制板上 AM62P 的 DRVVBUS 通过 10k 下拉电阻器连接到 SN74LV1T08(与门)的输入。  
但是、当 DRVVBUS 输出高电平时、预期电压电平约为 1.8V、但仅达到约 0.5V。
另一方面、移除下拉电阻器会导致 DRVVBUS 输出电压约为 1.8V。

在这些条件下、DRVVBUS 输出电平下降的原因可能是什么?
DRVVBUS 端子的驱动强度设置是否不适当?  

感谢您的支持。

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  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Hello Tsubasa Hatada、

    默认情况下、该引脚启用其下拉电阻器。 无需使用外部电阻器在复位期间保持 DRVVBUS。 请参阅数据表中的快照:

    另外、我不知道图中的另一个信号是什么、但请注意、它会影响 USB 控制器的会话开始和会话结束逻辑。 请记住这一点、以防您在 USB 连接/枚举方面遇到问题。

    谢谢。此致、

    Stan

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    你好 Stanislav Stilyanov,

    感谢您的答复。

    我忽略了默认引脚配置。
    实际上、默认情况下会启用内部下拉电阻。
    我知道在 1.8V 模式下、内部下拉电阻为 15 –30kΩ;但是、我担心内部下拉电阻和外部连接的下拉电阻的组合电阻值似乎不够低、无法防止驱动 DRVVBUS。
    内部下拉电阻器的规格参考是否不正确?



    >另外,我不知道图中的其他信号是什么,但请注意,它会影响 USB 控制器的会话开始和会话结束逻辑。
    >如果您遇到 USB 连接/枚举问题、请牢记这一点。

    我同意这一点。 添加了与门来控制负载开关以实现 VBUS 独占性、从而支持 DRP USB-C
    我们已经确认、这对 USB 控制器的会话开始和结束逻辑没有影响。

    感谢您的支持。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    [引用 userid=“574817" url="“ url="~“~/support/processors-group/processors/f/processors-forum/1620407/am62p-causes-of-the-decrease-in-drvvbus-terminal-output-level/6248771 “]我担心内部下拉电阻和外部连接的下拉电阻的组合电阻值似乎不够低、无法防止驱动 DRVVBUS。 [/报价]

    你是对的。 10K || 15k(最小情况)不应阻止正常条件下主动驱动高达 VDD。

    从您的图中、我只能怀疑这可能来自两个方向:

    • VDDSHV0 — 该电源轨上可能有一些额外的不需要的串行电阻。 或者、电源过载(不太可能)  
    • 与栅极 — 由于某种原因,总的输入电阻比正常值低。  

    此致、

    Stan

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    大家好!  

    请隔离“与运算“逻辑并快速进行检查。

    此致、

    Sreenivasa.