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[参考译文] AM6412:AM64x GPMC 同步突发读取时序和等待置为有效期间的 NOE 行为

Guru**** 2803725 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1624095/am6412-am64x-gpmc-synchronous-burst-read-timing-and-noe-behavior-during-wait-assertion

器件型号: AM6412

您好、

我对 AM64x 上的 GPMC 接口有疑问。

GPMC 配置

我们计划使用以下 GPMC 配置值。
您能否回顾一下、如果有任何不适当的设置、请告诉我们?

(ATTACHEDDEVICEPAGELENGTH 的值可能因 CS 配置而异。)

GPMC_CONFIG1 0x28C41201 
GPMC_CONFIG2 0x00171201
GPMC_CONFIG3 0x00030301
GPMC_CONFIG4 0x0D0B0D0B
GPMC_CONFIG5 0x020A1712
GPMC_CONFIG6 0x8C080484
GPMC_CONFIG7 0x00000E50

2.同步突发读取期间的行为(4 个字,需等待)

我们使用上述配置测试了同步突发读取(4 个字,启用了等待)。
观察到的波形如附图所示。

我们预期在释放等待信号后、在读取数据传输开始的时间、NOE (RE_N) 将置为有效。

然而、在我们的测量中:

  • 即使 WAIT 仍然有效、NOE 时序也会被置为有效

  • 被置为有效的 NOE 的持续时间似乎根据等待激活周期延长

在标有“突发读取?“的波形部分中、当连接的器件输出数据时、Sitara 成功接收到读取的数据、因此数据传输本身似乎正常工作。

我们的问题是:

  • 该行为(NOE 在等待活动期间被置为有效并根据等待持续时间延长)是否根据 Sitara GPMC 规范预期?

作为参考、附加了测量的波形。

如有任何澄清、将不胜感激。

此致、
Conor

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    尊敬的 Conor:

    我将尝试在今天晚些时候或明天上午欧盟时间作出回应。

    谢谢、

    Stan

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    尊敬的 Conor:

    我不确定检查设置的方向。 我已从 ... config1 和 CONFIG7 中提取设置。 请检查这是否为预期配置。

    • GPMC CLK 频率= GPMC_FCLK 频率/2
      地址和数据多路复用的附加器件
      NOR 闪存、异步和同步器件
      16 位总线
      等待输入引脚为 WAIT0
      在有效数据之前、会在一个 GPMC CLK 周期中监测 WAIT 引脚
      不监测 WAIT 引脚的写入访问情况
      监测 WAIT 引脚以获取读取访问权限
      页面(突发)长度= 8 个字
      GPMC CLK 激活时间=在 START 访问时间 GPMC CLK 的第一个上升沿
      写入同步
      读取同步
      单次访问

      基址[A29:A24]= 0x010000
      CS 大小= 32MB

    我尚未查看时序参数的配置设置。 这些参数必须在闪存数据表中描述的范围内。

    2. 同步突发读取期间的行为(4 个字,带等待)

    我认为这很好。 NOE 将允许存储器驱动总线、但读取的数据不会显示、直到存储器准备就绪(等待降至 0)。

    此致、

    Stan