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[参考译文] TDA4VEN-Q1:J722 串行器/解串器 REFCLK 规格

Guru**** 2893300 points

Other Parts Discussed in Thread: TMUXHS4212, LMK3H2104, LMK3H0102, TDA4VEN-Q1

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1638675/tda4ven-q1-j722-serdes-refclk-specifications

器件型号: TDA4VEN-Q1
主题中讨论的其他器件: TMUXHS4212LMK3H2104LMK3H0102、

您好 TI、

在第 96 页的 sprsp96b 表 6-3 中:

  1. Vrefclk_term 是指使用内部端接时可以提供给任何单个 SERDESx_REFCLK0 引脚的最大单端*峰峰值*电压吗? 那么、±Ω 差分峰峰值电压会使这两倍吗?
  2. Rterm 是否指单个 SERDESx_REFCLK0 引脚上的内部端接? 因此、差分内部 Rterm 阻抗的标称值是 100 Ω 吗?
  3. 是否可以阐明 SERDESx_REFCLK0 引脚上的标称 Vocm 和 Vicm 偏置电压? 我们希望检查这是否处于 TMUXHS4212 在 Vcc=1.8V 下运行所需的 0 - 1.2Vmax 范围内。

PS: 当我尝试在问题描述中插入欧姆符号时、对话框会要求我“请输入英文文本“并拒绝接受提交。 请问您能解决这个问题吗?

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    Bernhard

    1) 是的、差分电压会翻倍。

    2) 是的差分术语阻抗将是 100 欧姆标称值。  

    3) 是的、输出最大电压小于 1.2Vmax。  

    PS:我可以在没有警告的情况下插入欧姆 Ω 符号。 不确定它是否取决于所使用的 Web 浏览器。

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    您好 ShreyasRao,

    感谢您的答复。 是否可以澄清、请:

    1) 表 6-3 中的 Vrefclk_term 规格是否是指使用内部端接时可以提供给任何单个 SERDESx_REFCLK0 引脚的最大单端*峰峰值*电压? 或者这可能是 rms 还是其他度量吗?

    3) 在直流去耦配置中、SERDESx_REFCLK0 上的*Vicm*偏置电压是否也始终低于 1.2V(在该配置中,Vicm 仅由 TDA4 决定)?

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    尊敬的 Bernhard:

    1) 这些规格指的是标称运行中的最大值、但引脚可承受的绝对最大值将因其 Vdd 电源电压而更高。  

    这是您所指的吗?  

    2) Vicm 将低于 1.2V。

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    您好 ShreyasRao,

    1) 本规范定义了直流去耦时钟的最大标称单端输入电平。 因此、“最大值“可能不是指直流电平、因为不知道 SOC 将围绕哪个 VCM 进行时钟偏置。 时钟通常由其他参数定义。

    能否确认“450mV“是否指:

    1A) 450mV 峰峰值进入 50Ω 内部终端

    1b) 450mV rms 连接到 50Ω 内部终端

    1c) 任何其他措施?

    SERDES REFCLK 输入是否假定采用 LVDS 或 HCSL(或其他)差分标准?

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    尊敬的 Bernhard:

    我还在等待同事的答复。

    它们是 SERDES 输入的 HCSL 标准。

    450mV 表示 p 流入 50 欧姆。 我会将其分配给我的同事进行确认。  

     

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    您好 ShreyasRao,

    谢谢你。 EVM 在 SERDES REFCLK 输入端似乎没有直流去耦电容器、类似器件通常需要这些电容器。 您是否可以确认、这些是特别不需要的? 或者、时钟是否应该使用通常的 10nF 进行直流去耦?

    是否可以确认 SERDES REFCLK 输入是否可由 LP-HCSL 和 LVDS 输出驱动? 这就是 EVM 上的时钟发生器似乎提供的功能(如果安装)、以及 lmk3h2104 等类似器件。

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    关于直列式电容器(交流耦合)-这取决于接收器输入要求。 如果接收器接受 HCSL 或 LP-HCSL、则无需交流耦合电容器。  如果接收器是 LVDS — 则可能需要交流耦合电容器。

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    【已删除】
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    您好 Robert:

    在这种情况下、您 (TI) 是接收者。  ShreyasRao 建议 SERDES REFCLK 输入符合 HCSL 标准、但 J722 EVM(如安装)上使用的 lmk3h0102 以差分方式支持“仅“LP-HCSL 和 LVDS(而不是 HCSL)。

    我们希望使用类似的器件、即 lmk3h2104 为这些输入计时。 是否可以确认 SERDES REFCLK 输入将与 EVM 上安装在 U3 上的器件一起工作? 尽管 EVM 上时钟发生器和 SOC 之间使用的无源器件似乎指向 HCSL 目的、但其中设计的 lmk3h0102 似乎不支持此目的。

    lmk3h0102(通过扩展,我们希望使用的 lmk3h2104)是否 在 U3 的 J722 EVM 上工作、如果是、则必须使用哪种模式? AC-LVDS 的规格? 或直流 LVDS?  非常希望确认 SERDES RECLK 输入是否可以接受 AC-LVDS、DC-LVDS 或 LP-HCSL。

    或者、请显示 TDA4VEN-Q1 SERDES REFCLK 输入结构、以便我们可以看看这是否起作用。 当前的数据表在许多方面都非常不透明。  TDA4VEN-Q1 的 Vicm 规格将非常有助于试图解密这一信息。 输入在内部偏置到什么 ICM 电压(以查看是否可以进行直流去耦)?

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    关于无源器件 — 同意 LMK 器件附近的内联串联终端对于 LP-HCSL 模式应为 0 Ω。  一些其他 TDA4 器件 EVM 使用采用 33 Ω 系列的 HCSL 驱动器、因此 会造成 混淆。

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    您好 Robert:

    谢谢你。 在这种情况下、建议使用三个选项 (AC-LVDS、DC-LVDS 或 LP-HCSL) 中的哪一个作为输出格式?

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    我认为 Shreyas 之前已经确认(接收器为 HCSL)-因此可以直接从 LP-HCSL 获取。

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    您好 Robert:

    对于 LP-HCSL 选项、我担心 为 lmk3h0102 列出的最小 VOH 为 625mV(典型值)。 这似乎超过了 450mVpp(最大 SE)规格。 J722 输入的所有测试点。

    您同意吗? 如果是、是否可以 将 AC-LVDS 或 DC-LVDS 与所需的摆幅配合使用并与所需的共模电压兼容?

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    我将让分配到此主题的其他人对 J722 输入的电压范围/规格进行注释。  如果需要、可以使用标准方法将 AC-LVDS、DC-LVDS 等转换为 HCSL(我确实检查了 Google 搜索并找到了几个带示例的文档)