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[参考译文] AM4378:输入信号上升时间和输入信号下降时间的最小值

Guru**** 1145030 points
Other Parts Discussed in Thread: AM4378
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1091140/am4378-min-values-for-input-signal-rise-time-and-input-signal-fall-time

部件号:AM4378

您好,支持团队,

我对输入信号上升时间和输入信号下降时间的最小值有疑问。

问题1:关于数据表"MMC. 17.1 5.12 电气数据和定时"中的输入信号上升时间和输入信号下降时间,
是否需要严格遵守最小值1ns?

当前示意图如下所示。

DAT3从eMMC到CPU的波形如下所示。

时间轴刻度没有相对于过渡时间进行扩展,但它在400到500 ps之间。
上升时间阈值如下所示
VILmax:0.65 * 1.8 = 0.63V
VIHMIN:0.35 * 1.8 = 1.17V
*与1.8V VCCQ一起使用


恒定变化后的波形如下所示。


更改后的常量如下所示

CPU侧的阻尼电阻器:56Ω Ω
eMMC侧的阻尼100Ω:μ A
CMD和数据(7:0)线路上的外部上拉电阻器(eMMC附近的上拉电阻):10 kΩ


问题2. 我检查了以下线程。是否将上升时间从10 % 指定为90 % ,而不是从VILmax指定为VIHMIN?

e2e.ti.com/.../am437x-input-signal-rise-time-and-fall-time-from-nand-flash-memory

对于eMMC,JEDEC将VILmax指定为VIHMIN,因此我们测量了相同的时间段。

此致,
Kanae

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    问题1:关于数据表"MMC. 17.1 5.12 电气数据和定时"中的输入信号上升时间和输入信号下降时间,
    是否需要严格遵守最小值1ns?

    回答1. 计时条件表中定义的输入上升/下降时间 用作MMC外围设备计时关闭时的输入信号限值,以满足 数据表本节中定义的所有计时要求和开关特性。  您的客户需要对其系统实施执行计时分析,其中他们在 考虑 PCB延迟和采购设备的切换特性的组合时,会考虑每个设备的计时要求。 如果他们的系统 有足够的余量来计算 “计时条件”表中列出的实际最小上升/下降时间与最小上升/下降时间之间的差值,则他们应该不会遇到上升/下降时间更快的问题。

    客户在测量所附波形中显示的上升时间时,在哪里探测DAT3信号?  我提出这样的问题,因为 根据探头 沿传输线放置的位置,上升/下降时间有所不同。  它们需要在AM437x针脚处进行探测。 我还想知道,当   由eMMC设备驱动而不是由AM437x驱动时,他们如何确定这些波形正确代表信号上升时间。

    问题2. 我检查了以下线程。是否将上升时间从10 % 指定为90 % ,而不是从VILmax指定为VIHMIN?

    回答2: 我认为另一条线是正确的。 我们的计时结束团队最有可能使用10 % 到90 % ,而不是VILmax到VIHMIN。

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    您好,Paul:

    非常感谢您的回复。
    关于您的问题,我将与客户确认,
    因此,我们需要一些时间才能与您联系。

    此致,
    Kanae

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    您好,Paul:

    客户测量点如下所示。


    从AM437x端子拔出的接线上的以下位置有一个阻尼电阻器,
    我们在阻尼电阻器的垫上测量。
    AM437x端子到阻尼电阻器垫的距离约为6 mm。

    客户验证这些波形是信号在行驶时的上升时间
    eMMC设备基于以下内容。

    运行测试程序从eMMC读取数据后,已确认
    信号由基于与CLK相位关系的eMMC设备驱动。
    如果由CPU驱动,则在确认DAT更改的同时确认CLK的下降边缘。


    <Paul>
    回答2: 我认为另一条线是正确的。 我们的计时结束团队最有可能使用10 % 到90 % ,而不是VILmax到VIHMIN。


    我的客户对您的答案有着了解;回答2。
    他的另一个问题在这里。

    问:我只想确认一下,我对每个外围设备输入信号的上升和下降时间的理解是否正确
    在10 % 至90 % 的范围内指定了AM437x的,而不考虑MMC?

    在10 % 至90 % 期间,我在以下条件下再次检查了上升和下降次数,
    结果是上升时间为1.9ns,下降时间为2.6ns,在数据表中所述的1至5ns范围内。

    [主板设计时准备的常量]
    -eMMC一侧的阻尼电阻:0Ω Ω
    -CPU端的阻尼电阻:33Ω Ω



    我正在等待你对另一个问题的答复。

    此致,
    Kanae

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    上升/下降形状通常在近端失真,在大约中端供应时会出现不连续性。 我几乎 可以肯定 ,正在测量的信号 是根据 上升/下降形状在传输线远端附近探测的。 但是,我不确定他们在哪里探测信号。 查看与时钟相关的数据转换延迟是确认 转换捕获的另一个好方法,它是eMMC源的结果。 根据上述信息,我们现在确定 测量的升/降是AM335x数据输入信号。

    AM335x是一种非常古老的设计,因此可能很难找到确切的答案。 我先前的评论是基于我们今天所使用的方法。  我怀疑流程没有改变,因为我们的 所有IO计时模型都基于10/90电压限制。 在对外围设备执行定时关闭时,我们使用  指定的电压限值将工业标准/规格的任何上升/下降时间要求转换为转换速率,然后将转换速率应用到我们的10/90限值。 这可以有效 地根据 行业标准调整上升/下降时间要求,以匹配我们的模型。

    我很高兴看到您的客户非常努力地确认系统符合我们的计时要求,但   违反最小上升时间时很少遇到任何计时风险,因为这一时间通常很小,任何违规行为都更小。 许多外围设备不要求我们定义 定时闭合的最小上升/下降时间,但使用的定时闭合工具需要最小和最大值。 在这些情况下,我们通常使用 的值小于我们认为在实际系统中可能使用的值。

    此致,
    保罗

       

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    您好,Paul:

    您的回复中确实提到了AM335x,但我的客户正在使用AM4378。
    AM335xAM437x是否错误?
    您的答案也是关于AM437x,我的理解是否正确?

    此致,
    Kanae

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    我很抱歉混淆了,我的回复仍然有效,因为AM335x和AM437x 是使用 相同的技术节点构建的,并且使用相同的IO设计。

    此致,
    保罗

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    您好,Paul:

    感谢您的及时回复。
    我现在将与客户分享,作为AM437x的答案。

    此致,
    Kanae