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[参考译文] AM4378:PRU和SPI0或闪存引脚映射.. uBoot分区..

Guru**** 1145030 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1102863/am4378-pru-and-spi0-nor-flash-pin-mapping-uboot-partitions

部件号:AM4378
Thread:sysconfig中讨论的其它部件

您好,AM4团队,

我的客户有以下问题。

我们的团队需要对SPI0 NOR Flash的使用进行说明。 感谢您对此的回复。

目前,我们正在使用SPI0 NOR闪存启动主板。 我们还需要使用PRU ICSSS 0 UART进行串行通信,以及其他现有UART。 但这会与我们正在寻找的SPI0交换或闪存到其他一些针脚的针脚产生冲突。 在这里,我们不是使用NOR闪存的默认SPI0引脚(其中存储了MLO)来引导设备,而是使用备用SPI0引脚(SPI0_CS0;AD25,SPI0_D1;AB25,SPI0_SCLK; AE21)用于连接SPI NOR闪存。 我们想了解,如果我们将SPI NOR闪存移至备用SPI0引脚,引导ROM是否可以检测到SPI NOR闪存。

由于SPI0默认引脚与PRU ICSS 0冲突,我们还在评估替代方法,以丢弃SPI NOR闪存并在eMMC boot0/boot1分区中加载MLO。 这不是eMMC (FAT32)的第一个FAT分区。 这是eMMC供应商提供的用于存储bootloader/boot config数据的引导区域。 我们想了解当前的TI uBoot是否支持boot0/boot1分区以及安全启动实施。

 此外,我们观察到从SPI0或闪存加载MLO大约需要10到15秒。 是否有方法可以优化此功能?

我们的团队需要对SPI0 NOR Flash的使用进行澄清。 感谢您对此的回复。

谢谢,Merril

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    对于SPI引导,ROM代码将pine-mux寄存器配置为使用表5-34中定义的来自如下所示TRM的引脚。  很遗憾,这是硬编码,没有任何选项可更改。

    我使用 https://dev.ti.com/sysconfig上的sysconfig工具快速查看 了一下,您说的对,与PRUICSS0 UART引脚有直接冲突。 我没有看到任何可以解决此问题的pin mutxing选项。 我确实看到PRUICSS1 UART没有冲突,但这当然取决于您是否已经将这些引脚用于其他用途。

    我认为我以前没有看过它,但也许有一种方法从SPI0启动,然后在启动后,重新配置PRUICSS0 UART的引脚,然后在那时使用UART。 这可能需要更改电路板,以某种方式添加由GPIO控制的外部mux,以确保在一种模式或另一种模式下,UART和SPI之间不会发生冲突。  

    我必须让我们的Linux专家回答与eMMC引导相关的问题,但我要说,eMMC是引导和存储文件系统的常见方法。  首先,我将查看 我们的SDK中的U-Boot文档。 下一节介绍eMMC分区

    https://software-dl.ti.com/processor-sdk-linux/esd/AM437X/07_03_00_005/exports/docs/linux/Foundational_Components/U-Boot/UG-Memory.html

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    TI Linux专家,您好!

    是否有任何更新?

    谢谢,Merril

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    您好Merril

    此线程似乎分配错误。 我已将其分配给新的所有者。

    我们可能需要一些时间来回复,如果不是更早的话,预计下周某个时间会收到回复。

    此致

    穆库尔