[FAQ] [参考译文] [常见问题解答] TMS320C6678：如何在 C6678 EVM 上运行 TSIP 示例

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1057046/faq-tms320c6678-how-to-run-tsip-example-on-c6678-evm

器件型号：TMS320C6678

如何在 C6678 EVM 上运行 TSIP 示例？

3 年多前

0 admin 3 年多前

TI__Guru**** 2361370 points

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C667X 器件上的 TSIP

要求

适用于 C667x的 TI-RTOS SDK，版本：6.03。
Code Composer Studio (CCS)

过程

确保 CCS、TI-RTOS SDK 安装正确。
转到 Windows 资源管理器中的"C：\ti\pdk_c667x_2_0_16\packages "文件夹、并通过在地址栏中键入"cmd"打开命令提示符。

使用以下命令创建 TSIP 项目

C:\ti\pdk_c667x_2_0_16\packages>pdksetupenv.bat
***************************************************
Environment Configuration:
***************************************************
    SDK_INSTALL_PATH        : C:/ti
    PDK_INSTALL_PATH        : C:/ti/pdk_c667x_2_0_16/packages
    GMAKE_INSTALL_PATH      : C:/ti/xdctools_3_55_02_22_core
    PDK_SOC                 : c667x
    PDK_VERSION             : 2_0_16
    RULES_MAKE              : C:/ti/pdk_c667x_2_0_16/packages/ti/build/Rules.make
***************************************************
C:\ti\pdk_c667x_2_0_16\packages>pdkProjectCreate.bat C6678 all little tsip all dsp "C:\ti\pdk_c667x_2_0_16\packages"
=========================================================================
Configuration:
   SOC             :   C6678
   BOARD           :   all
   ENDIAN          :   little
   MODULE          :   tsip
   PROJECT_TYPE    :   all
   PROCESSOR       :   dsp
   PDK_SHORT_NAME  :   "C:\ti\pdk_c667x_2_0_16\packages"
=========================================================================
Checking Configuration...
Complete
=========================================================================
   PDK_PARTNO         : C6678L
   PDK_ECLIPSE_ID     : com.ti.pdk.c667x
   RTSC_PLATFORM_NAME : ti.platforms.evm6678
   RTSC_TARGET        : ti.targets.elf.C66
   CCS_DEVICE         : "com.ti.ccstudio.deviceModel.C6000.GenericC64xPlusDevice"
*****************************************************************************
Detecting all projects in PDK and importing them in the workspace "C:\ti\pdk_c667x_2_0_16\packages"\MyExampleProjects
Detected Test Project: TSIP_evmc6678_c66exampleProject

--------------------------------------------------------------------------------
Creating project 'TSIP_evmc6678_c66exampleProject'...
Done!

第一个命令用于设置环境变量、
第二个命令在"C：\ti\pdk_c667x_2_0_16\packages\MyExampleProjects"文件夹中创建"TSIP 测试和示例"项目。

在 CCS 中、导入 TSIP 项目、
1. 第1页：File -> Import -> CCS Projects (in Code Composer Studio)-> Next。
2. 第2页：选择搜索目录->浏览，转到路径“C:\ti\pdk_c667x_2_0_16\packages/MyExampleProjects”，然后在“已发现的项目”部分仅选择 TSIP 项目。
3. 选择项目、右键单击并选择"Rebuild Project"、现在将编译项目并编译二进制文件。
为"C6678"器件创建目标配置、
1. 要查看"Target configurations"、请转到"View"->"Target configurations"。
2. 我们可以创建基于"用户定义"和"项目"的配置。
3. 打开"ccxml"文件、在 "Basic"标签页中、选择"connection"中的仿真器类型、选择"Board or device"中的 Processor"。
4. 在高级选项卡中、选择内核并从"C：\ti\ccs_930\ccs\ccs_base\emulation\boards\evmc6678l\gel"文件夹中选择 GEL 文件。
5. 确保 DIP 开关设置处于"无引导"模式、以便在 RAM 上运行 CCS 工程。
6. 现在打开电路板电源、然后右键单击创建的"ccxml"文件并选择"Launch Selected configuration"。

访问电路板、

连接以太网端口以启用 TSIP、连接详细信息如下所示。
在"Debug"窗口中、选择内核(任何一个内核都足够了)、然后右键单击并选择"Connect to target"、现在器件上的特定内核将被连接。 (要获取调试窗口、请使用"View -> Debug"选项)。
转至"运行->加载->选择要加载的程序"、在对话框中选择"从工程"、然后选择为 TSIP 工程创建的"输出"。
现在、在"Core 0"上运行的 TSIP 示例将启用端口0并配置时隙、如下所示。

[C66xx_0] **************************************************
********** TSIP Test Start ***********************
**************************************************
Initialize application buffers.
TSIP driver instance successfully initialized 
-----------------------
TSIP port 0 is powered up
TSIP port instance successfully initialized 
TSIP port 0 super frame interrupt is registered
Enabling TSIP timeslot TX 0x0 RX 0x0... 
TSIP timeslot TX 0x0 RX 0x0 successfully enabled 
Enabling TSIP timeslot TX 0x1 RX 0x1... 
TSIP timeslot TX 0x1 RX 0x1 successfully enabled 
Enabling TSIP timeslot TX 0x2 RX 0x2... 
TSIP timeslot TX 0x2 RX 0x2 successfully enabled 
Enabling TSIP timeslot TX 0x3 RX 0x3... 
TSIP timeslot TX 0x3 RX 0x3 successfully enabled 
Enabling TSIP timeslot TX 0x4 RX 0x4... 
TSIP timeslot TX 0x4 RX 0x4 successfully enabled 
Enabling TSIP timeslot TX 0x5 RX 0x5... 
TSIP timeslot TX 0x5 RX 0x5 successfully enabled 
Enabling TSIP timeslot TX 0x6 RX 0x6... 
TSIP timeslot TX 0x6 RX 0x6 successfully enabled 
Enabling TSIP timeslot TX 0x7 RX 0x7... 
TSIP timeslot TX 0x7 RX 0x7 successfully enabled 
Enabling TSIP timeslot TX 0x8 RX 0x8... 
TSIP timeslot TX 0x8 RX 0x8 successfully enabled 
Enabling TSIP timeslot TX 0x9 RX 0x9... 
TSIP timeslot TX 0x9 RX 0x9 successfully enabled 
Enabling TSIP timeslot TX 0xa RX 0xa... 
TSIP timeslot TX 0xa RX 0xa successfully enabled 
Enabling TSIP timeslot TX 0xb RX 0xb... 
TSIP timeslot TX 0xb RX 0xb successfully enabled 
Enabling TSIP timeslot TX 0xc RX 0xc... 
TSIP timeslot TX 0xc RX 0xc successfully enabled 
Enabling TSIP timeslot TX 0xd RX 0xd... 
TSIP timeslot TX 0xd RX 0xd successfully enabled 
Enabling TSIP timeslot TX 0xe RX 0xe... 
TSIP timeslot TX 0xe RX 0xe successfully enabled 
Enabling TSIP timeslot TX 0xf RX 0xf... 
TSIP timeslot TX 0xf RX 0xf successfully enabled 
Enabling TSIP timeslot TX 0x10 RX 0x10... 
TSIP timeslot TX 0x10 RX 0x10 successfully enabled 
Enabling TSIP timeslot TX 0x11 RX 0x11... 
TSIP timeslot TX 0x11 RX 0x11 successfully enabled 
Enabling TSIP timeslot TX 0x12 RX 0x12... 
TSIP timeslot TX 0x12 RX 0x12 successfully enabled 
Enabling TSIP timeslot TX 0x13 RX 0x13... 
TSIP timeslot TX 0x13 RX 0x13 successfully enabled 
Enabling TSIP timeslot TX 0x14 RX 0x14... 
TSIP timeslot TX 0x14 RX 0x14 successfully enabled 
Enabling TSIP timeslot TX 0x15 RX 0x15... 
TSIP timeslot TX 0x15 RX 0x15 successfully enabled 
Enabling TSIP timeslot TX 0x16 RX 0x16... 
TSIP timeslot TX 0x16 RX 0x16 successfully enabled 
Enabling TSIP timeslot TX 0x17 RX 0x17... 
TSIP timeslot TX 0x17 RX 0x17 successfully enabled 
Enabling TSIP timeslot TX 0x18 RX 0x18... 
TSIP timeslot TX 0x18 RX 0x18 successfully enabled 
Enabling TSIP timeslot TX 0x19 RX 0x19... 
TSIP timeslot TX 0x19 RX 0x19 successfully enabled 
Enabling TSIP timeslot TX 0x1a RX 0x1a... 
TSIP timeslot TX 0x1a RX 0x1a successfully enabled 
Enabling TSIP timeslot TX 0x1b RX 0x1b... 
TSIP timeslot TX 0x1b RX 0x1b successfully enabled 
Enabling TSIP timeslot TX 0x1c RX 0x1c... 
TSIP timeslot TX 0x1c RX 0x1c successfully enabled 
Enabling TSIP timeslot TX 0x1d RX 0x1d... 
TSIP timeslot TX 0x1d RX 0x1d successfully enabled 
Enabling TSIP timeslot TX 0x1e RX 0x1e... 
TSIP timeslot TX 0x1e RX 0x1e successfully enabled 
Enabling TSIP timeslot TX 0x1f RX 0x1f... 
TSIP timeslot TX 0x1f RX 0x1f successfully enabled 
TSIP Port 0 configured
-----------------------
TSIP data transfer...

谢谢、

Rajarajan U

处理器（参考译文帖）

处理器（参考译文帖）(Read Only)

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