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[参考译文] DM505:DM505与 TDA3

Guru**** 1958595 points
Other Parts Discussed in Thread: DM505
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/766498/dm505-dm505-vs-tda3

器件型号:DM505

您好!

我的客户正在进行可行性研究、以便将现有的基于 TDA3的软件(我相信基于 proc SDK 雷达的软件)移植到 DM505。

根据我的调查、这些器件几乎相同、

  • 引脚兼容  
  • 相同的工作条件和电源序列
  • 引脚多路复用配置几乎相同
  • TDA3 (芯片修订版本2.0)看起来像 DM505 (芯片修订版本2.0)

但 DM505不支持以下功能。

  • 存储器循环冗余校验(CRC)
  • TESOC (LBIST/PBIST)  
  • 错误信令模块(ESM)  
  • 实时中断(RTI)  

`m、如果我错了、请告诉我。

`m、我现在检查 TRM 中的存储器映射、发现以下差异。

DM505
IPU_UNICACHE_MMU 0x5888_0000~0x5888_0FFF 4KiB ........ IPU_UNICACHE_MMU 配置寄存器
TDA3
IPU_UNICACHE_MMU 0x5888_0800~0x5888_0FFF 2KiB ........ IPU_UNICACHE_MMU 配置寄存器
DM505
IPU_WUGEN 0x5888_1000~0x5888_1FFF 4KiB… IPU_WUGEN 配置寄存器
TDA3
IPU_WUGEN 0x5888_1000保留
对我来说、这有点令人惊讶、因为我觉得没有理由在核心相关部分存在差异。 本文档是否缺失? 还是真正的差异?
此致、
NK
 
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    您好、

    不同的功能似乎是正确的。 我假设您比较了器件特定数据手册中的器件比较表。

    关于存储器映射差异:

    •  第一个差异(IPU_UNICACHE_MMU)是由于 DM505的 TRM 未更新。 DM505的最后一本书于2017年10月发布、而该问题在2018年7月的 TDA3x TRM 中进行了更新。 因此、该区域的正确值为2KiB。
    • 关于第二个区别(IPU_WUGEN)、我不确定您在寻找什么。 请查看 TDA3x TRM 的最新版本、VC:   

    IPU_WUGEN 0x5888_1000 0x5888_1FFF 4KiB IPU_WUGEN 配置寄存器  

    此致、

    Mariya

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    我看到、您实际上是在要求 L3_main 映射。

    TDA3x 信息对 TDA3x 和 DM505均有效。 表2-1显示了 L3_MAIN 访问的区域。

    只能从 L3互连访问存储器、AMmu 和 L2-MMU 配置空间。 无法从 L3互连访问共享缓存寄存器。

    一般来说、外部主器件只能访问议会联盟的部分内部区域。  表2-8中的注释(2)标记了这些区域。 IPU 内存映射。

    我希望这将有所帮助。

    此致、

    Mariya

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    您好、Mariya、

    感谢您的快速回复。 好的。 那么、现在我们可以参考最新的 TDA3x TRM、直到 DM505 TRM 更新出现为止吗? (出于原因、我们应考虑上述仅限 TDA3x 功能的限制)

    此致、
    NK
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    您好、Naoki Kawada、

    目前、包括 TRM 在内的 DM505文档支持已从我们的计划中删除、因此、请参阅最新的 TDA3x、其中考虑了两种器件之间的差异。

    此致、
    Mariya
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    您好!

    目前、包括 TRM 在内的 DM505文档支持已从我们的计划中删除、这就是为什么、考虑到两个器件之间的差异、请参阅最新版本的 TDA TRM。

    此致、
    Mariya
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