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[参考译文] DRA744:DRA744 EMIF_ext_phy_regs 设置问题

Guru**** 2558250 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/849762/dra744-dra744-emif_ext_phy_regs-setting-issue

器件型号:DRA744

大家好、团队成员  

我的项目中有两种变体。 它们是相同的 SCH 设计。 唯一不同的是 DDR3布局布线。  我们使用相同的 DDR3。 SoC 是 DRA777。 除硬件驱动程序代码外,应用程序软件也是相同的。

现在、项目要求对两个变体使用一个相同的 U-boot 代码。 对于这两个变体,我们如何针对   EMIF 寄存器设置的不同 DDR3布局使用相同的 u-boot 代码?

您能给我们一个详细的建议。  n`t 有不同的代码硬件 ID 来识别不同的 PCBA。

谢谢你   

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    通常、EEPROM 应描述不同电路板版本之间的细微差异。

    例如 RAM 类型、大小和其他硬件说明。

    第一步 u-boot 是检测电路板、然后在此基础上选择合适的 DTB 来探测不同的硬件。

    您应该执行相同的操作。 针对两个项目分别对 EEPROM 进行编程。

    此致、

    Nikhil D

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    您好,

    抱歉,我们已经修复了我们的设计,SCH,布局现在不能更改 --- 无 EEPROM。  因此,我们必须找到一个解决方案来解决此问题。

     是否有任何方法可以在一个 u-boot 代码中覆盖不同的 DDR3迹线长度?

    谢谢。

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    您好!


    我假设您已经拥有 EEPROM。

    我不知道任何基于 DDR 的电路板检测机制。

    Nikhil D

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    你(们)好,Nikhil

    我的解决方案在这里,您能帮助分析吗?

    我将 EMIF_EXT_PHY_CONTRAL_26保持为35  至0,因此根据硬件调平算法,  DDR3延迟校准过程的起点值 将从0至255开始 。  这意味着无论 DDR3迹线长度(<=3000mil)是什么, 算法都会为这两种型号的电路板找到合适的延迟值。

    这是否正常?

    谢谢。

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    n`t 我的解决方案,我们将确定它是哪个变体。  我们只将 DDR3 HW 调平起始点保留为0,  它将覆盖不同的 DDR3迹线长度。  

    是否提供此功能?  将 EMIF_EXT_PHY_CONTRAL_26的代码设置  为35至0。

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    您好,

    您能帮助回答这个问题吗?

    谢谢。

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    您好!

    如果这在 u-boot 中是可以接受的、我将尝试从 EMIF 专家处获得帮助

    Nikhil D

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    您好!

    由于这在专用 e2e 线程中已关闭、我将关闭此线程。