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[参考译文] TDA2EVM5777:A15_0上 chains_vipSingleCameraFrameCopy 的目标地址和源地址

Guru**** 2611385 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/582733/tda2evm5777-the-destination-address-and-source-address-for-chains_vipsinglecameraframecopy-on-a15_0

器件型号:TDA2EVM5777

尊敬的:

我想在 A15_0上的 chains_vipSingleCameraFrameCopy.c 中添加一些数据处理、

您能告诉我此用例的目标地址和源地址吗?

提前感谢。

BRS、

门格

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    大家好、Meng、

    您能否详细说明您的用例? 您要添加哪种类型的数据处理?  

    在其他一些用例中、PD/TSR 等算法在接收到的数据上运行。 您可以将其用作参考 关于源地址和目标地址、由于内存是从堆动态分配的、因此地址不是固定的。 您可以在 CCS 中添加变量名称并查看其地址。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好 Prasad、

    感谢你的答复。

    实际上、我想根据 chains_vipSingleCameraFrameCopy.c 在 Cortex-A15上添加算法处理、

    我快速浏览了代码、但在此示例中执行存储器复制时无法找到 DEstation 和源地址?

    然后、我使用这两个缓冲区(存储器复制源和目标地址)作为算法输入和输出指针来执行算法?

    您能告诉我哪个数据结构包含输入和输出缓冲器吗? 如果详细浏览代码、可能需要更多时间。

    我只对它进行一些测试。

    提前感谢

    BRS、
    门格
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    您好 Prasad、

    以下数据结构似乎适用于不同链路之间的通信?

    typedef 结构{

      uint32.     numBuf;

      /**<缓冲区列表中的缓冲区数量*/

      System_Buffer *缓冲区[system_MAX_buffers_in_buffer_list];

      /**<指向各个缓冲区的指针*/

    } System_BufferList;

     

    提前感谢您。

     

    BRS、

    门格

     

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    是的、缓冲器位于共享存储器中、并在通过 IPC 发出通知时由多个内核访问、简而言之、IPC 是 VSDK 链接和链框架。

    每个链路(任务排序)都保留缓冲区池以用于数据接收/处理。 缓冲区通过 getEmptybuffers 和 putFullbuffers 调用共享。

    如果需要更多详细信息、请参阅 VSDK 架构文档。

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    Prasad、您好!

    非常感谢您的回复。

    BRS、
    门格
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    您好 Prasad、

    顺便说一下、您能告诉我该平台中所有内核的共享存储器是相同的吗?

    或者、不同的两个内核之间有不同的共享存储器?

    提前感谢。

    BRS、
    门格
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    抱歉、有一些误解、您能告诉我 TDA2EVM5777中共享存储器的地址吗?

    非常感谢。

    BRS、
    门格
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    大家好、Meng、

    地址将根据使用的配置而变化。
    您可以参阅 build\tda2xx\mem_segure_define_512MB_BIOS.xs (如果使用 Linux build、则为1024MB)、并为该内存和其他共享位置找到 SR1_frame_buffer_ADDR。
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    您好 Prasad、

    一般而言、共享存储器应使用哪种存储器?

    也就是说、共享存储器位于 RAM 中、还是 SDRAM 中?

    BRS、
    门格
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    尊敬的 Meng:

    SR1位于 DDR 中、所有内核均可访问该内核。
    OCMC 是另一个可使用的内存(大小受限)。

    此致、
    Rishabh