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[参考译文] CCS/AM3352:SYSBOOT 引脚驱动问题

Guru**** 2582405 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/595536/ccs-am3352-sysboot-pins-drive-issue

器件型号:AM3352

工具/软件:Code Composer Studio

初始化后、我将 SYSBOOT 引脚用作 GPIO。 例如、SYSBOOT[4:0]通过外部上拉/下拉设置为0x11001。 它们在初始化后配置为 GPIO 并连接到 FPGA。

在测试期间、我在处理器上设置 GPIO 的输出值、并监控 FPGA 内的引脚值。 对于上拉引脚、我可以成功地将其驱动为高电平/低电平。 但对于下拉引脚、即使将处理器侧的 GPIO 输出设置为高电平、FPGA 中的值也不能达到高电平。 在我的板上、上拉寄存器为100K、下拉寄存器为10K。

外部下拉寄存器是否会影响 GPIO 的值? 这些引脚的正确外部下拉寄存器值是多少?

谢谢、

文勇

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    检查这些引脚的引脚多路复用器中是否启用了内部上拉/下拉电阻器。
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    我之前尝试过所有上拉/下拉组合、包括启用/禁用内部上拉、设置内部上拉/下拉。 不管用。 这就是我怀疑外部下拉电阻是否太强的原因。

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    您是否检查了是否是 FPGA、它会将这些信号下拉?
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    感谢您的远程响应。 我修改了 FPGA 设计、问题得到了解决。

    此致
    文勇