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[参考译文] TMS320DM8148：如何关闭 CVBS 输出上的同步？

admin
Guru**** 2582405 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/594699/tms320dm8148-how-to-switch-off-sync-on-the-cvbs-output

器件型号：TMS320DM8148

您好！

是否有人知道如何关闭 CVBS (TV/SD)输出上的 SYNC 信号的发送？  我们使用的是 DM8148 HDVPSS 之外的 PAL 或 NTSC 格式的 S 视频。

我在 DM38x DaVinciTm数字媒体处理器高清视频处理子系统(HDVPSS)用户指南(spruhi7a.pdf)中找到了视频处理器寄存器文档以及相应的源，目前我正在设置寄存器 SD_VENC_cvbs0，即位27-16和11-0为0， 但显示器仍然显示(尽管失真且完全不稳定)画面。

是否有另一种方法可以抑制电视输出上的同步？ 当我关闭驱动程序时、显示器仍会同步信号。 这背后的原因是、某些显示器无法同步时也会关闭背光。

此致、

Uli

  • 0
    TI__Guru**** 2582405 points
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    您好！

    您使用的是哪个软件版本？

    此致、

    Anuj

    Pathpartner Technology Pvt Ltd

  • 0
    TI__Guru**** 2582405 points
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    您好！

    我添加的代码位于 TI81xx-HDVPSS-01.00.01.37之上。 但我认为这没有影响、因为当我在设置寄存器后读出寄存器时、这些值完全是应该的值。 但是、我发现行为取决于显示器！ 有些人只是按预期报告"不同步"、有些人则顽固地尝试在某种情况下同步...

    那么、HDVPSS 上是否有另一个寄存器可以修改、以减少监视器仍然以某种方式同步信号的机会、或者我是否运气不好、也需要关闭驱动程序？

    此致、
    Uli
  • 0
    TI__Guru**** 2582405 points
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    您好 Ulrich、

    是否要关闭(抑制)以下信号/引脚？

    VOUT[0]_HSYNC/AC11
    VOUT[0]_VSYNC/AB13

    VOUT[1]_HSYNC/AC24
    VOUT[1]_VSYNC/AA23

    此致、
    帕维尔
  • 0
    TI__Guru**** 2582405 points
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    您好、Pavel、

    这些是来自 ti814x 的物理引脚、对吧？ 当我修改的软件是 HDVPSS 驱动程序时、我是否可以直接访问以直接禁用这些引脚上的输出？ 我只是想暂时关闭 HSYNC 和 VSYNC、而不是完全通过引脚复用...
    或者、我是否不知道这些引脚上的输出不受 ti814x 的 HDVPSS 部分的控制？ 您真诚地把我弄糊涂了...

    此致、
    Uli
  • 0
    TI__Guru**** 2582405 points
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    [引用 user="Ulrich Teichert"]这些是来自 ti814x 的物理引脚，对吗？[/quot]

    是的

    [引用 user="ulrich Teichert"]由于我要修改的软件是 HDVPSS 驱动程序，我是否可以直接访问以直接禁用这些引脚上的输出？

    是的、您可以从 Linux 内核(驱动程序)访问这些引脚、但不能从用户空间访问这些引脚

    [引用 user="Ulrich Teichert"]您真的很困惑我...

    为什么？ 到目前为止、我没有给您任何指导、我只是问了您一个问题、以便了解您的问题。 为什么您会对一个简单的问题感到如此困惑？

    此致、
    帕维尔

  • 0
    TI__Guru**** 2582405 points
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    您好、Pavel、

    我很容易混淆硬件，主要是一个软件人员:-)我很感激您努力找出我的问题是什么，真的。

    知道电视输出(CVBS)的信号受 HDVPSS 控制、修改它的寄存器让我在某处找到了、我认为这些寄存器*专门*定义了电视输出上发生的情况。 但您的问题向我表明这是错误的、并且 ti814x 的其他部分也对这些引脚具有物理访问权限、因此我可能只关注视频输出信号生成的一小部分。 我希望情况并非如此、但我感到困惑...

    但是、您可能只是想建议通过关闭这些引脚上的输出来更激进地解决我的问题、对吧？

    此致、
    Uli
  • 0
    TI__Guru**** 2582405 points
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    Ulrich、

    我可以想到的一种解决方案是切断(门) HDVPSS 子系统的输入时钟。 该时钟来自视频 PLL。 一旦这个时钟被选通、我预计同步线路上的信号将停止。

    另一种方法可能是将引脚多路复用器从 vsync 更改为复位值(MUXMODE[7：0]= 0)

    此致、
    帕维尔
  • 0
    TI__Guru**** 2582405 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Pavel、

    感谢您的建议、我之前已经使用过时钟设置、但我并不满意。 我将尝试这两种方法、并将报告回来、但这需要一段时间、

    此致、
    Uli
  • 0
    TI__Guru**** 2582405 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Uli、

    您还可以尝试使用 sysfs 条目禁用用户隔离器中使用的 VENC：

    启用/禁用 VENC
    # echo 0/1 >/sys/devices/platform/vpss/display0/enabled
    # echo 0/1 >/sys/devices/platform/vpss/display1/enabled

    您还可以尝试使用无效的时钟源来更改时钟源：

    echo dclk/dclkdiv2/dclkdiff >/sys/devices/platform/vpss/display0/clksrc
    echo aclk/aclkdiv2/aclkdiff >/sys/devices/platform/vpss/display1/clksrc

    有关更多信息、请参阅以下 wiki 页面：

    processors.wiki.ti.com/.../TI81XX_PSP_VPSS_Video_Driver_User_Guide

    此致、
    帕维尔