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[参考译文] 66AK2H14：DDR3PLL 输入的输入频率

admin
Guru**** 2551110 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/602188/66ak2h14-input-frequency-for-ddr3pll-inputs

器件型号：66AK2H14

您好！

K2H 的 EVM 使用100MHz 作为 DDR3A 和 DDR3B PLL 时钟输入引脚的输入。  

我想知道这些引脚是否有任何其他经过测试/验证的时钟输入。

硬件设计指南还仅指定了这些引脚的时钟范围、未给出任何测试值。

此致、

Madhu。

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    TI__Guru**** 2551110 points
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    您好、Madhu、

    我已将此内容转发给硬件设计专家。 他们的反馈应发布在此处。

    BR
    Tsvetolin Shulev
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    TI__Guru**** 2551110 points
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    马德胡

    据我所知、我们在设计中使用了100MHz DDR 输入时钟并进行了验证。 但是、有几个客户在其设计中使用了不同的时钟输入。 我建议您在指定范围内使用时钟输入并相应地计算 PLL 参数。

    此致、
    SENTHIL
  • 0
    TI__Guru**** 2551110 points
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    您好！

    感谢您的回复。

    我计划为 DDR3 PLL 使用125MHz 时钟。  

    因此、我想知道是否有客户报告过使用100MHz 以外的频率时出现的任何问题。

    因为 DDR3在我的设计中非常重要、它必须以800MHz 的速度运行。

    此致、

    Madhu。

  • 0
    TI__Guru**** 2551110 points
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    您好！

    是否有人可以回答上述问题？

    提前感谢。

    此致、
    Madhu。
  • 0
    TI__Guru**** 2551110 points
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    马德胡

    接受125MHz 的 DDR 输入时钟、但我不确定是否有任何客户在其设计中验证过该时钟。 您可能需要正确选择 PLL 参数以满足所需的 DDR 速率。

    此致、
    SENTHIL