[参考译文] TMS320C6748：upp 和引导引脚多路复用

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https://e2e.ti.com/support/processors-group/processors/f/processors-forum/635647/tms320c6748-upp-and-boot-pin-multiplexing

器件型号：TMS320C6748

您好！

我想在全双工模式下使用 uPP、发送和接收的所有16条线路都是如此。 uPP XDATA[7..0]的引脚与 BOOT[7..0]引脚复用。在这种情况下如何使用引导引脚？ upp 是高速接口、用于引导逻辑的外部电阻器对于速度线路是坏的。

谢谢！

8 年多前

0 admin 8 年多前

TI__Guru**** 2588505 points

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BR
Tsvetolin Shulev

0 admin 8 年多前

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谁可以回答我的问题？

0 admin 8 年多前

TI__Guru**** 2588505 points

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很抱歉、此问题的响应延迟。 n`t 当前支持的此器件评估平台没有 uPP 接口、因此我必须仔细研究存档以提供有关此主题的指导。

引导模式引脚仅用于在上电复位时锁存引导模式的值、因此该引脚在引导时默认为引导模式引脚运行。引导后、您可以在引脚上设置引脚多路复用器、并在需要时将其用于 upp 操作。

我相信 LogicPD EVM 上通过扩展连接器提供了 uPP 接口、可实现16线操作。您可以查看硬件设计文件。由于硬件设计文件仅供该评估平台的现有注册用户使用、因此我在此提供了文档的链接：
www.deyisupport.com/.../2211.aspx

我相信需要使用 VPIF DOUT 引脚的 LCD 用户也会遇到同样的问题、因此我相信这些引脚在外设操作后可用于引导。

在该器件上使用 uPP 接口的其他参考设计是通过 Critical Link 提供的 MityDSP 平台。您还可以参考他们平台的硬件设计。

此致、
Rahul

0 admin 8 年多前

TI__Guru**** 2588505 points

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感谢您的回复。我知道、引导后可以使用该引脚的功能。但 uPP 端口的速度接近75MHz。我认为、如果我将在布局上的该速度线路上使用上拉和下拉电阻器、则该线路无法正常工作。测试 uPP 线路是否与引导引脚结合？

0 admin 8 年多前

TI__Guru**** 2588505 points

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此处提供了此器件在 EVM 平台上使用旧版驱动程序的 upp 测试数据：
software-dl.ti.com/.../index_FDS.html

此致、
Rahul

0 admin 8 年多前

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本文档不提供测试所用的引脚信息。在文件令状中、使用 uPP 通道1。如果使用不带引导模式的引脚(UPP_D 引脚)、我相信 uPP 具有该速度。但在文档中未描述哪些引脚组 UPP_D 或 UPP_XD (与引导模式引脚复用)用于测试...

处理器（参考译文帖）

处理器（参考译文帖）(Read Only)

[参考译文] TMS320C6748：upp 和引导引脚多路复用