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[参考译文] TDA3MV:vddshv 引脚电源工作流程(使用22965和65919_otp52 REGEN1)

Guru**** 2614265 points
Other Parts Discussed in Thread: TPS22965-Q1, TPS65919-Q1, TDA3MV

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/659244/tda3mv-vddshv-pins-supply-workflow-using-22965-and-65919_otp52-regen1

器件型号:TDA3MV
主题中讨论的其他器件:TPS22965-Q1TPS65919-Q1

你好。

假设 tda3所有双 vddshv1-6将使用单个3V3供电。
建议将负载开关 TPS22965-Q1用于加电 vddshv。
它具有简单的逻辑。 如果 ON=Lo、则 VOUT (vddshv)=GND、如果 ON=Hi、则 VOUT=VIN (VSYS_3V3)。

我可以看到、出于这一目的、TPS65919-Q1 (OTP=0x52)具有 GPIO3/REGEN1开漏输出(不带内部拉电阻器)。
因此、我几乎不会对该引脚到 VRTC (LDORTC_OUT=1V8)的外部上拉电阻器感到困惑。

您能解释 vddshv 的加电工作流吗?

我可以假设第一级降压(SYS_3V3 OUT)将为22965加电、并且由于 ON 引脚具有上拉电阻、这个开关将输入 SYS_3V3传输到 Vddshv 引脚、与65919上的 LDOVRTC 类似。
稍后将启动919 OTP 并执行 OFF2ACT 序列、因此 REGEN1 (VRTC 开漏) OUT 将为低电平、然后为高电平(SLVUAS4C-Aug16第14页、图7)。
因此、22965 ON 引脚将为低电平、然后为高电平。
由于22965 ON 引脚(65919 REGEN1引脚) 具有外部上拉电阻、是否可以实现 vddshv 初始上升状态?

此致。

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    您好!

    是定制板还是 EVM?

    从 TDA3x EVM 原理图中可以看出、ON 引脚被 PMIC 的 VDDS_18V 拉高。 然后、顺序应为:

    1级降压上电

    2. ON 引脚为低电平、因为 VDDS_18V 未激活

    3. PMIC 启动

    4. VDDS_18V 启动。 ON 引脚仍然为低电平、因为 PMIC 当时将其驱动为低电平

    5. PMIC 在正确的时刻从低电平转换为高电平

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    您好、Stanislav。
    我正在设计定制 TDA3板的原理图。
    EVM 板使用与现代 OTP=52 (GPIO 分配不同)不兼容的旧 OTP 版本。
    因此、我们购买了 O919A152TRGZRQ1器件和 TDA3MV 生产器件。
    因此、EVM 原理图不适用于52版 PMIC。
    此问题与您的(3)-(4)备注有关。

    SLVA900 (2017年8月)第4页显示


    由于 GPIO3/REGEN1是使用 OTP 定义的、因此我很担心在 OTP 尚未初始化的情况下会发生意外的导通。


    SLVSDM1 (2017年8月)第35页显示大约6ms。


    这个6ms 时间是否用于 OTP 初始化?
    OTP 尚未初始化时、GPIO3引脚的状态是什么?

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    "由于 GPIO3/REGEN1是使用 OTP 定义的、因此我很担心在 OTP 尚未初始化的情况下会发生意外的导通。"

    你是对的。 因此、必须将开关的导通输入上拉至仅在 PMIC 启动后启动的电源轨。

    "这6ms 时间用于 OTP 初始化吗?"

    是的,这是我的理解

    '在 OTP 尚未初始化时、GPIO3引脚的状态是什么?'

    我不能说。 我认为、目的是在初始化期间将输出缓冲器保持在低电平。 但这不仅是 OTP 初始化问题。 在功率斜升期间(即大容量电容充电)、输出引脚可能处于未定义或悬空状态。

    在所有情况下、将引脚拉至 PMIC 的1.8V SMPS 输出应消除任何毛刺脉冲。 这就是在 TDA3 EVM 中完成的方法。 请参阅上面屏幕截图中的注释。

    此致、

    STAN