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[参考译文] DRA756：计时器 PWM 输出抖动

admin
Guru**** 2609775 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/654606/dra756-timer-pwm-output-jitter

器件型号：DRA756

您好！

我正在研究如何将 DRA75x 计时器 PWM 输出(在切换模式下)用于500kHz 至2MHz 范围内的次级系统时钟。   理想情况下、这些信号需要具有相当低的抖动(<=1ns)。  假设 计时器输出 将与 L4外设时钟同步。  因此、请查找有关这些输出抖动的任何信息。  例如、如果使用频率为20.0MHz 的 sysclk1作为计时器的时钟源、并且 L4外设时钟为133MHz、那么计时器输出是否会受到7.5nS 抖动(1/133.3MHz)的影响？

谢谢、
Eric

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    TI__Guru**** 2609775 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Eric：

    我认为计时器使用 CM_CORE_AON_TIMER 概述部分中所述的所选功能时钟运行。

    L4时钟不应影响计时器性能、还是缺少什么？

    此致、

    STAN

  • 0
    TI__Guru**** 2609775 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Stan、

    感谢您的回答。  这是我要查找的验证。  因此、您会说 L4外设接口时钟不会影响计时器 PWM 输出抖动(即从计时器块到输出的 L4时钟没有资格认证)。  因此、任何抖动分量都将仅限于功能时钟(以及与功能时钟相关的内部电路)。  

    谢谢、
    Eric

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    TI__Guru**** 2609775 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Eric、
    是的、计时器计数器根据功能时钟工作(取决于多个源)。 寄存器访问需要 L4时钟、根据 TRM、L4时钟甚至可以暂停以节省功耗、计时器可以同时生成唤醒请求(在发生溢出或其他事件时)。

    此致、
    STAN