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[参考译文] Linux：J6 Entry DRA718 GPU DPLL 无法锁定

admin
Guru**** 2582405 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/632740/linux-j6-entry-dra718-gpu-dpll-can-not-locked

工具/软件：Linux

您好！

J6条目的 GPU 通常可以正常工作、但我们发现一个板的 GPU 无法正常工作。Linux 内核日志有一行[时钟：
DPLL_GPU_CK 无法转换到"锁定"]]。因此、我获取了有关 GPU DPLL 的寄存器 CM_IDLEST_DPLL_GPUL=0x2而不是0x1f、因此 GPU DPLL 无法锁定。

由于 GPU DPLL 无法锁定、GPU GCLK = SYS_CLK1 = 20MHz、但不能锁定425MZH、GPU 将四 张图片呈现为大约2 FPS。 太慢了！

我们可以采取哪些措施 来避免电路板的 GPU DPLL 无法锁定？

 

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    TI__Guru**** 2582405 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Sheng、

    您是否使用 PROCESSOR-SDK-LINUK-Automotive 03_03_00_03？

    software-dl.ti.com/.../index_FDS.html

    此致、
    帕维尔
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    TI__Guru**** 2582405 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    [引用 USER="SHENG HUHUU"]但我们发现一个主板的 GPU 无法正常工作

    您是否意味着您只有一个不能解决许多问题？ 如果是、则最有可能是此板的硬件故障。 您可以开始调试、验证主要 osc 要求是否符合 DRA71x DM。 您还可以检查 VDDA_GPU 电源引脚。

    此致、
    帕维尔

  • 0
    TI__Guru**** 2582405 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    当然、我在硬件上进行了调试、SYS_clk1为20MHz、VDDA_GPU 为1.8V。 但 DDR、GMAC 等其他 DPLL 可以正常工作！ 我的问题是、我们可以做些什么来让 GPU DPLL 正常工作、或者硬件损坏、我们无法执行任何操作？ 我使用 PROCESSOR-SDK-LINUK-Automotive V3.2.0.3版本。
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    TI__Guru**** 2582405 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Sheng、
    如果我理解得好、您只有一个故障电路板、对吧？
    -您说过您测量了 VDDA_GPU、但您测量的 VDDA_GPU 是否与 SoC 最接近？ 例如、最近的电容器或过孔等
    更好的方法是测量 CAP_vddram_GPU 引脚(和 CAP)、因为这是 GPU DPLL LDO 的输出。 虽然我不知道确切的值... 但介于1V 和~1.6V 之间的电压应该是一个良好的开端。
    -您还可以测量其他 GPU 模拟电压。
    -最后、请注意 GPU 的唯一时钟源不是 GPU_DPLL、您也可以使用内核或每个 DPLL。 他们可能无法达到最佳时钟速率、但我认为、如果其他任何事情发生故障、他们可以做到这一点。

    此致、
    STAN
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    TI__Guru**** 2582405 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    Sheng、

    [引用 USER="SHENG HUANG ]我的问题是、我们可以做些什么来让 GPU DPLL 正常工作、或者硬件坏了、我们不能做任何事情？[/引用]

    最好尽量减小 N 参数的值(它可以最大限度地减少锁定时间和抖动)。 然后应选择 M 以提供正确的频率(尽可能具有最低的差值)。

    您还可以尝试使用重校准来补偿可能的硬件问题、请参阅 DRA71x TRM 第3.6.3.12.4节 DPLL_GPU 重校准

    如果仍然无法锁定 GPU DPLL、则可以尝试使用 CORE_DPLL_HS_CLK (旁路时钟)、而不是 GPU_DPLL_CLK (参考时钟)。 有关此功能的更多信息、请参阅 DRA71x TRM。

    您还可以比较工作板和非工作板之间的 DPLL_GPU 寄存器值、并查看是否存在任何差异。

    关于硬件问题调试、您还可以查看 DRA71x DM、表5-25。 DPLL A 型特性以及5.9.4.3.3 DPLL 和 DLL 噪声隔离

    此致、
    帕维尔