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[参考译文] TDA2xx:Starterware EDMA3基址/参数集数量/ L2SRAM 全局地址说明

Guru**** 2558250 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/622316/tda2xx-starterware-edma3-base-addresses-number-of-param-sets-l2sram-global-addresses-clarification

大家好、我将使用 Vision SDK 2.10并在 TDA2xx 上进行测试。

我尝试在 C66x 内核上使用 starterware_01_06_00_16来利用 EDMA。 这意味着我要使用 C66x 专用 EDMA、而不是系统 EDMA。 我对此处加入的通道控制器基址有一些疑问:...vision_sdk_02_10_00_00\ti_componations\drivers\starterware_01_06_00_16\include\c66x\tda2xx\soc.h

这3个因素令人困惑。

#define SOC_DSP_EDMA_CC_BASE (0x1d10000U)
#define SOC_DSP1_EDMA_CC_BASE (0x40d10000U)
#define SOC_DSP2_EDMA_CC_BASE (0x41510000U) 

当从 DSP 访问时、我知道第一个地址是本地地址(我之前成功使用过该地址)。 对应的 EDMA 的其他两个全局地址吗?

我还发现:

#define SOC_EDMA_CC_BASE (0x3300000U) 

它是系统 EDMA 基址的定义吗? 如果是这样、那么它不是0x43300000、当我之前将系统 EDMA 与 EDMA3 LLD 一起使用时、它是0x43300000。

此外、我还有一个问题是有关 DSP 专用 EDMA 中参数集的数量。

在这里、我发现它是128: https://e2e.ti.com/support/arm/automotive_processors/f/1021/p/553514/2029041#2029041

但是,我想看到一份文件,我可以在其中正式找到这些资料。 我看了 一下:http://www.ti.com/lit/an/sprac21/sprac21.pdf 、但在任何地方都找不到它。 我还需要查看有关需要添加到 L2SRAM 分配缓冲区地址的0x40000000偏移量的信息、以获取其全局地址。

提前感谢您。

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    您好、Nik、

    我已将您的问题转发给 Starterware 专家。

    此致、
    Yordan
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    您好、Nik、

    1)是、当 DSP 自身访问时、SOC_DSP_EDMA_CC_BASE (0x1d10000U)是 DSP 内部 EDMA 的本地地址。

    是的、SOC_DSP1_EDMA_CC_BASE (0x40d10000U)和 SOC_DSP2_EDMA_CC_BASE (0x41510000U)是相应 DSP EDMA 的全局(L3_MAIN)地址。

    2)根据 DSP 存储器映射(请参阅"表2-10 ")。 DSP 存储器映射)、DSP 似乎对地址0x0330_0000处的系统 EDMA 具有直接/专用访问权限。 因此、当 DSP "私有"访问时、SOC_EDMA_CC_BASE (0x3300000U)应是系统 EDMA 基址的定义。

    否则、系统 EDMA 的全局地址实际上是0x43300000、如您所述。

    3) 3) DSP EDMA 中的参数集数量记录在"表16-82中。 TMM 中的 EDMA 通道控制器配置。

    但愿这对您有所帮助。

    此致、
    瓦西勒
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    您好、Vasil、

    感谢您的帮助、这消除了所有困惑。

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    大家好、我还有几个关于 DSP 专用 EDMA 的问题、我在 TRM 中找不到这些问题。

    1) 1) DSP 内核和 EDMA 如何在内部和外部存储器之间仲裁总线访问的意义上访问它们? EDMA 有自己的总线吗?我发现总线的宽度是128位、还是与内核共享?

    2) 2)在我在原始帖子中包含的第二个链接中、建议将源/目标地址与默认突发大小边界对齐。 我不确定如何对齐这些数据以提高性能、因为数据在传输控制器中进行缓冲后、有望达到默认突发大小、然后被写入。 这是与存储器组相关还是与其他内容相关?

    提前感谢您。
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    您好、Nik、

    我已与一位专家进行了联系、就您的新问题发表了意见。

    此致、
    Yordan
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    您好、Nik、

    DSP CPU 访问通过 MDMA 路径进行、EDMA 访问通过 EDMA 路径进行。  图5-1. TDA2x TRM 中突出显示的 DSP 子系统将为您提供一些想法。 到 DSP 内部 L1/L2存储器的仲裁是通过 DSP L2互连完成的、外部存储器访问是通过 L3接口仲裁的。 用于 DSP CPU 和 DMA 访问的总线不是共享的。

    猝发是互连使用单个命令 address 将一个数据块传输到目的的一种机制。 突发大小的数据与该单个命令相关联。 当我们传输非突发大小对齐的地址/大小时、使用附加对齐地址发送未对齐的开始/结束部分、并使用字节使能总线来指示要写入的字节数。 如果多次执行这些额外访问、则会降低传输效率。

    希望这对您有所帮助。

    谢谢、此致、

    Piyali

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    Piyali、
    感谢您的回答。